FUSB2805MLX [ONSEMI]
USB 2.0 高速 OTG 收发器，带 ULPI 接口;
| 型号： | FUSB2805MLX |
| 厂家： | 
ONSEMI |
| 描述： | USB 2.0 高速 OTG 收发器，带 ULPI 接口 驱动 接口集成电路 驱动器 |
| 文件： | 总50页 (文件大小：1634K) |
| 中文： | 中文翻译 | 下载： | 下载PDF数据表文档文件 |
Is Now Part of
To learn more about ON Semiconductor, please visit our website at
www.onsemi.com
Please note: As part of the Fairchild Semiconductor integration, some of the Fairchild orderable part numbers
will need to change in order to meet ON Semiconductor’s system requirements. Since the ON Semiconductor
product management systems do not have the ability to manage part nomenclature that utilizes an underscore
(_), the underscore (_) in the Fairchild part numbers will be changed to a dash (-). This document may contain
device numbers with an underscore (_). Please check the ON Semiconductor website to verify the updated
device numbers. The most current and up-to-date ordering information can be found at www.onsemi.com. Please
email any questions regarding the system integration to Fairchild_questions@onsemi.com.
ON Semiconductor and the ON Semiconductor logo are trademarks of Semiconductor Components Industries, LLC dba ON Semiconductor or its subsidiaries in the United States and/or other countries. ON Semiconductor owns the rights to a number
of patents, trademarks, copyrights, trade secrets, and other intellectual property. A listing of ON Semiconductor’s product/patent coverage may be accessed at www.onsemi.com/site/pdf/Patent-Marking.pdf. ON Semiconductor reserves the right
to make changes without further notice to any products herein. ON Semiconductor makes no warranty, representation or guarantee regarding the suitability of its products for any particular purpose, nor does ON Semiconductor assume any liability
arising out of the application or use of any product or circuit, and specifically disclaims any and all liability, including without limitation special, consequential or incidental damages. Buyer is responsible for its products and applications using ON
Semiconductor products, including compliance with all laws, regulations and safety requirements or standards, regardless of any support or applications information provided by ON Semiconductor. “Typical” parameters which may be provided in ON
Semiconductor data sheets and/or specifications can and do vary in different applications and actual performance may vary over time. All operating parameters, including “Typicals” must be validated for each customer application by customer’s
technical experts. ON Semiconductor does not convey any license under its patent rights nor the rights of others. ON Semiconductor products are not designed, intended, or authorized for use as a critical component in life support systems or any FDA
Class 3 medical devices or medical devices with a same or similar classification in a foreign jurisdiction or any devices intended for implantation in the human body. Should Buyer purchase or use ON Semiconductor products for any such unintended
or unauthorized application, Buyer shall indemnify and hold ON Semiconductor and its officers, employees, subsidiaries, affiliates, and distributors harmless against all claims, costs, damages, and expenses, and reasonable attorney fees arising out
of, directly or indirectly, any claim of personal injury or death associated with such unintended or unauthorized use, even if such claim alleges that ON Semiconductor was negligent regarding the design or manufacture of the part. ON Semiconductor
is an Equal Opportunity/Affirmative Action Employer. This literature is subject to all applicable copyright laws and is not for resale in any manner.
2013年10月
FUSB2805
带 ULPI 接口的 USB 2.0 高速 OTG 收发器
特性
说明
. 符合 USB 2.0 修订版 1.3 的 OTG 补码和 ULPI 修
订版 1.1
FUSB2805是UTMI+低引脚接口(ULPI) USB2.0 OTG收发器。
它符合通用串行总线规格修订版 2.0 (USB 2.0)、ULPI
规范修订版 1.1 和 USB 2.0 修订版 1.3 On-The-Go
(OTG) 附录的规定。
. 支持 480 Mbps、12 Mbps 和 1.5 Mbps USB2.0 速度
-集成终端电阻，满足 USB2.0 电阻 ECN
-集成串行器和解串器
FUSB2805 可通过 ULPI 链接器将 USB2.0 主机、外设或
OTG 控制器连接到 USB 连接器进行优化。可通过 12 位
(SDR) 接口以高速 (480Mbps)、全速 (12Mbps) 和低速
(1.5 Mbps) 三种速率传输和接收数据。
-根据需要插入和删除填充位
-USB 时钟与数据恢复可达 ±150pp
. 支持USB OTG修订版1.3主机协商协议（HNP）和会话
申请协议(SRP)
相关资源
UTMI+ 低引脚接口规范 (ULPI) 修订版 1.1，2004 年 10
月 20 日。http://www.ulpi.org
. 15 kV ESD，IEC 61000 电路板级，空气间隙
UTMI+ 规范修订版 1.0，2004 年 2 月 22 日。
http://www.ulpi.org
应用
. 机顶盒视频照相机, MP3播放器
. 移动电话，数字照相机，PDA
. DVD录像机, 扫描仪，打印机
如果您需要更多的性能信息，请联系
analogswitch@fairchildsemi.com。
订购信息
器件编号
顶标
工作温度范围
封装
32 端子模塑无铅封装 (MLP)，四通道，
FUSB2805MLX
FUSB2805
-40 至 +85°C
JEDEC MO-220
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
框图
ULPI
Interf ace
Controller
Clock
D 0-D 7
D IR
USB D ata
Serializer
D P
USB 2.0 ATX
STP
NXT
Register
Map
Termination
Resistors
USB D ata
D eserializer
D M
CHIP_SELECT_N
VD D 3V 3
ID _PULLUP
OTG Mo dule
ID D etector
Frequency
Select
CFG1
CLKIN
Glo bal
Clocks
ID
PLL
VBUS
Reset_N
PSW
VIO
0.1µF
VCC3V3
POR
Power-On
Reset
External
0.1µF
4.7µF
4.7µF
VBUS
& Fault
D etection
Control
Block
100k
VCC1V2
0.1µF
FAULT
RREF
Voltage
Regulator
VCC
Analog
Reference
Mo dule
IC (Float)
VR E F
Test (Float)
图1.
功能框图
引脚布局
32 31 30 29 28 27 26 25
D1
D0
24 D6
1
2
3
4
5
6
7
8
23 D7
VIO
DM
22 NXT
21 STP
GND
Exposed DiePad
RREF
DP
20 VIO
19 RESET_N
18 DIR
VCC
ID
17 VDD1V2
9
10 11 12 13 14 15 16
图2.
引脚配置（透视图）
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
2
引脚定义
符号 类型(1)
说明
Chip
I
低电平有效。高电平时，ULPI 引脚三态；低电平时，ULPI 正常工作。TTL兼容。CMOS 输入，具有滞环。
Select_N
RREF
DM
DP
AI/O
AI/O
AI/O
参考电阻。将阻值为 12 k 1% 的电阻连接至 GND。
USB D-引脚。USB模式: USB 线的数据负信号 (D-) 引脚。
USB D+引脚。USB模式: USB 线的数据正信号 (D+) 引脚。
FAULT 信号用来表示出现了来自外部 SMPS 或电源管理 IC 的 VBUS过流/过压条件。链接器必须通过
"ExternalVbusFault"[外部Vbus故障]寄存器位才能启用该功能， 而且必须通过"ExternalVbusActiveLow"[外部
Vbus有效低]寄存器位进行优先权设置。
FAULT
I
ID
I
P
micro-USB电缆的（识别）ID引脚。TTL；如果未用，连接至 3V3。
VCC
输入电源电压或电池电源
控制一个外部的、高电平有效、VBUS电源开关/充电泵和/或 SMPS 充电器 IC。需要一只外部 100 k下拉电阻。
开源结构，压摆率控制的输出；该引脚以 VCC3V3为参考。
PSW
O
VBUS
VCC3V3
CLKIN
I.C.
TEST
CFG1
VDD1V2
VIO
AI/O
P
应该连接至USB电缆的VBUS 引脚。未用时置于开路。该引脚上存在一只内部 90 k ±11% 下拉电阻。
3.3 V 稳压器输出，需要稳压电容。为内部OTG、模拟核芯和ATX供电。
时钟输入。频率依赖于CFG1引脚。属于数字输入缓冲，非晶振的模拟输入。
内部接线。引脚悬浮
I
I/O
I/O
I
内部接线。引脚悬浮
配置时钟频率；0： 输入为 19.2 MHz。1: 输入为 26 MHz。
1.2 V 稳压器输出，需要稳压电容。为内部数字核芯和模拟核芯供电。
输入 I/O 电源轨；通过 0.1 µF 电容连接到电源输入。
未用时连接至 VIO。复位收发器。有效低。
连接至地。
P
P
Reset_N
GND
I
P
DIR
O
ULPI 方向输出信号。
STP
I
ULPI 停止输入信号；CMOS 输入。
NXT
O
ULPI 下一个输出信号。
D7
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
O
ULPI 数据引脚 7；三态输出。
D6
ULPI 数据引脚 6；三态输出。
D5
ULPI 数据引脚 5；三态输出。
D4
ULPI 数据引脚 4；三态输出。
D3
ULPI 数据引脚 3；三态输出。
D2
ULPI 数据引脚 2；三态输出。
D1
ULPI 数据引脚 1；三态输出。
D0
ULPI 数据引脚 0；三态输出。
CLOCK
当施加数字 19.2 MHz（或 26 MHz）时钟时输出 60 MHz 时钟；上拉输出。
注意：
1. I=输入；O=输出；I/O=数字输入/输出；OD=开漏输出；AI/O=模拟输入/输出；P=电源或地。
2. 根据 USB 2.0，如果电源电压低于 2.97 V，虽然在较低电源供电下一些器件连同 FUSB2805 能够继续运行，但是
不能确保 USB 全速和低速操作。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
3
功能说明
USB 2.0 ATX
ULPI 接口控制器
USB 2.0 ATX结构是一个模拟前端电路， 包含有高速
(HS)、全速(FS)和低速(LS)模式的发送、接收和中断USB
总线所需的全部电路，用于USB外设、主机和OTG实现，符
合USB2.0规范及其相关补充。包含以下电路：
FUSB2805 支持一个 12 引脚接口 (SDR)，可兼容UTMI+低
引脚接口 (ULPI) 修订版 1.1 规范。该接口必须连接到
USB 链接控制器。
ULPI 控制器提供下列功能：
. 差分驱动器，用于在HS、FS 以及LS 下发送数据；
. ULPI 兼容接口和寄存器组
. 差分接收器和单端接收器，用于在HS、FS 以及LS 下
接收数据；
. USB 外设、主机和 OTG 功能的完全控制
. 优先级排列 USB 接收数据、USB 发送数据、中断和
寄存器操作
. 静噪电路，用于检测HS 总线活动
. HS断线检测器
. 解析 USB 发送与接收数据
. 45 DP 和 DM 引脚上的 HS 总线终端，用于外设
和主机模式
.
.
控制VBUS外部电源
. DP 引脚上的 1.5 kΩ上拉电阻，用于 FS 外设模式
（由于 FUSB2805 支持 HS，LS 外设时不支持 DM 电
阻上拉。）
VBUS监控、充电和放电
. 低耗模式
. 6- 和 3-引脚串行模式
. 产生 RX CMD(状态更新)
. 可屏蔽中断
. DP 和 DM 引脚上的 15 kΩ 总线终端，仅用于主机
模式。
锁相环与时钟产生
. 控制 ULPI 总线状态
FUSB2805 具有一个用于时钟产生的内置锁相环。
USB 串行器和解串器（串并转换器）
该锁相环从 CLKIN 输入方波时钟（19.2 MHz 或 26
MHz），倍频或分频后可以得到多种频率，供内部电路使
用。
USB 数据串行器准备通过 USB 总线发送的数据。为了发
送数据，USB 链接控制器在 ULPI 总线上发送命令和数
据。串行器进行并串转换、位填充和倒转不归零编码。对
于带有 PID 的数据包，在该数据包的开始位置，串行器
增加一个 SYNC 码型，在该数据包的结束位置，则增加一
个 EOP 码型。如果串行器较忙，不能接受更多数据，则
ULPI 接口控制器解除 NXT 声明。
从时钟源，PLL可以产生以下频率：
. 60 MHz 时钟，用于 ULPI 接口控制器
. 1.5 MHz 时钟，用于低速 USB 数据
. 12 MHz 时钟，用于全速 USB 数据
. 480 MHz 时钟，用于高速 USB 数据
USB 数据解串器对从 USB 总线上接收的数据进行解码。
收到数据后，解串器剥离 SYNC 和 EOP 模式，（若适
用）然后进行串并转换、倒转不归零解码并在数据净负荷
上进行位填充。通过声明（主张）DIR，ULPI接口控制器
向USB链接控制器发送数据，然后，只要准备好一个字节
就声明NXT。解串器还能检测多种接收出错，包括位填充
错误、弹性缓冲器欠量或超限、以及字节排队错误。
接口保护
如果链接器驱动ULPI接口出错，例如当链接控制器上电速
度慢于FUSB2805时，为了防止出现错误活动，在STP 引脚
上安置一个弱上拉电阻。
在任何时候，如果STP 引脚出现不期望高（HIGH），通过
在D[7: 0]各引脚上启用弱上拉电阻，FUSB2805能够保护
ULPI接口。
通过设置INTF_PROT_DIS位为1b (INTF_CNTRL[7])，可以
禁用接口保护方案。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
4
tPWRDN
3-State (ignored)
CLOCK
Chip_Select_N
D[7:0]
3-State (input)
3-State (ignored)
3-State (ignored)
STP
3-State (input)
NXT
DIR
3-State
3-State
图3.
Chip_Select_N 是ULPI的节电控制信号
通过 VCC3V3 引脚上一个带有 POR 触发阈值的比较器，可以
决定 PORB 解除声明，阈值 VPOR为 2.0 V。
利用 Chip_Select 限电
如果 CHIP SELECT_N 被解除声明（高电平），
FUSB2805 为 ULPI 接口各引脚设置三态，降低内部电
如果 CHIP SELECT_N 未用作节电控制信
图4说明了 PORB 脉冲与 VCC3V3引脚电压电平之间的对应关
系。图中还给出了当 VCC3V3跌落低于 VPOR，不论时间长短，
POR 对 PORB 的所作所为。
路的功耗。
号， 则它固定为低电平。图3显示 CHIP SELECT_N 被
声明然后又被解除声明时的 ULPI 接口性能。
上电结束后，CLOCK开始切换（toggling），则USB链接
控制器必须在ULPI总线上发布一个复位命令，确保正确
工作。
在持续时间 tPWRDN之后，时钟“CLOCK”输出进入三态，而
且被链接器所忽略。
PORB /
PLL
Reset
上电复位(POR)
内部稳压器的电源为 VCC。该电源要为 3.3 V 和 1.2 V
稳压器供电。3.3 V 稳压器的输出为 VCC3V3。1.2 V 稳压
器的输出为 VDD1V2。
PHY POR
VCC3V3
在上电阶段，POR保持在一个稳定状态，确保数字逻辑不
会误操作I/O或任何模拟电路，防止破坏系统其余电路。
VPOR
T0
T1
T2
T3
T4
VCC3V3 = 3.3V
VPOR = 2.2V
T1 = T0 + 40µs
T4 = T3 + 40µs
POR 结构的输出，即 PORB（内部信号），在电源爬升过
程中应该为 1'b0。一旦电源已经完成爬升，PORB应该解
除声明。该信号由 19.2/26 MHz 驱动到 12 MHz PLL。在
USB OTG PHY 结构中，POR 信号（高电平有效复位）必须
保持被声明，时间不小于 40μs。
图4.
上电复位序列
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
5
会话有效比较器
OTG模块
会话有效比较器为 TTL 电平输入， 用来判断何时VBUS
电压足够高可以开始一次会话。A- device与B- device
都需要采用该比较器去检测何时会话可以开始。A-
device还需要采用该比较器去判断何时会话已经完成。
会话有效阈值电压位于 0.8 V 至 2.0 V 之间。
OTG模块包含有多个子模块，具有"USB OTG修订版1.3的补
码"所需要的全部功能。具体来说，它提供有以下电路：
. ID检测器，能够检测micro-USB电缆的ID引脚。该ID
引脚能够指出哪一个设备被初始配置成主机和哪一个
设备被配置成外设。
会话结束比较器
.
VBUS比较器，能够确定VBUS电压电平。这是主机协商协
议(HNP) 和会话请求协议(SRP)所要求的。
会话结束比较器决定VBUS 何时低于 0.2 V 至 0.8 V 的
B-device 会话结束阀值。B-device 采用该阀值确定会
话何时结束。
.
VBUS临时充电与放电电阻。这是SRP所要求的。
ID检测器
SRP 充电与放电电阻
检测迷你 USB（或微型 USB）数据线插入哪一端。 必须
首先通过将ID_PULLUP寄存器位设置为 1b 来启用 ID 检
测器。假设在 ID 引脚上，FUSB2805 检测到一个不同于
前一次报告的值，一次 RX CMD 状态更新被发送到 USB
链接控制器，或声明一次中断。
FUSB2805 提供有片内电阻，用于VBUS进行短时充电和放
电。这些电阻由 B-device 使用，用于申请会话，并提示
A- device 恢复VBUS电源。首先，通过设置
DISCHARGE_VBUS 寄存器位为 1b，并等待 SESS_END 改变
为 1b，从上一次会话算起，B- device 查验VBUS已经完全
放电。然后，通过设置 CHARGE_VBUS 寄存器位为 1b ，
如果该电缆的micro-B端被插入，FUSB2805则报告ID_GND
为逻辑1，而且USB链接控制器更改为外设模式。
B- device 为VBUS充电。当 A- device 检测到VBUS的充电
已经高于会话有效阈值，接通VBUS电源，开始会话。
如果该电缆的micro-A端被插入，FUSB2805则报告ID_GND
为逻辑0，而且USB链接控制器更改为主机模式。
模拟参考模块
ID 引脚具有一个弱上拉电阻（400 kΩ），避免浮置状
况。当 ID_PULLUP 寄存器位为 0 时，该电阻被连接。如
果应用未使用 ID 引脚，将该引脚固定为 VCC3V3。
模拟参考模块能够提供稳定的内部电压和电流参考，用于
内部模拟电路偏置。该模块需要一只精确的外部参考电
阻。在 RREF 引脚与 GND 之间需要一只 12 k 1% 的
电阻。
VBUS 比较器
FUSB2805 具有三个比较器，可以用于检测 VBUS电压电
平，比较器清单如表9和表12所示。比较器如下所示：
VBUS有效比较器
该比较器供 A-device（或主机）使用，用于判断VBUS
引脚电压是否处于一个有效工作电平范围。VBUS 有效比
较器的最小阀值为 4.4 V。VBUS 上任何低于该阀值的电
压都被认为是故障。在上电过程中，比较器的输出被忽
略。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
6
引脚详细说明
D0 至 D7
RREF
引脚 D0 至 D7 为双向 ULPI 数据总线引脚。当ULPI总线
空闲时（DIR为L低），USB链接控制器必须驱动D0-D7为
低。当链接器具有数据发送到FUSB2805时，USB链接控制
器驱动一个非零值。
RREF为电阻参考模拟I/O引脚。需要 12 k 1% 的电
阻。
DP 和 DM 引脚
当处于USB模式时，DP引脚用作USB数据+线，DM引脚用作
USB数据-线。
数据总线可以重新配置，支持不同的数据类型。数据总线
共计有四种模式：
. 同步模式： 缺省模式为 SDR 模式(3)，8 位数据字
节，与时钟的上升沿同步。
DP 与DM 引脚应该连接到USB插座的D+ 与D-引脚。
故障
. 低耗模式： 承载异步线路状态和VBUS信息。
. 3 引脚串联模式： 承载异步 3 引脚 FS/LS 串行信
号。
该输出引脚由外部SMPS或电源管理IC使用，在过流或过压
故障条件下用来发出信号。在 OTG 主机中，这是适用
的，其中 PSW 用于控制驱动 VBUS，或在充电电流过高时
控制向 OTG SMPS 管理 IC 发出信号，如图5所示。
. 6 引脚串联模式： 承载异步 6 引脚 FS/LS 串行信
号。
ID
通过驱动chip_select_N为高，各数据引脚也可以具有三
对于 OTG 实现，（识别）ID 引脚连接到 mini-USB (或
micro-USB) 插座的 ID 引脚。正如 OTG 规范中的定义，
ID 引脚掌管着链接控制器的初始角色。如果 ID 引脚检
测为高，链接控制器必须承担外设角色。如果 ID 引脚检
测为低，链接控制器必须承担主机角色。角色可以随后利
用主机协商协议(HNP)来更换。
态。
注：
3. FUSB2805不支持 DDR。
VIO
FUSB2805 提供有内部上拉电阻，用于检测ID引脚的取
值。通过设置 ID_PULLUP 寄存器位为 1b，数值为
50 k的上拉电阻必须首先被启用。如果 ID 引脚的取值
发生更改，则 FUSB2805 向链接控制器发送一次 RX CMD
VIO为输入电源引脚，用来设置 I/O 电压电平。VIO为以下
引脚的衬垫进行在片供电：
. CLOCK
. DIR
. STP
或一次中断，ID 引脚检测时间为 tID。在 tID内，如果链
接控制器没有收到任何 RX CMD 或中断，则 ID 值不变。
. NXT
为了避免 ID 引脚浮动，当设置 ID_PULLUP 寄存器位为
0b 时，可以接入一只 400 k的上拉电阻。
. D0-D7
. RESET_N
. CFG1
Digital over-current protection scheme
with external power switch
5V
USB Trans
PSW
OTG Host
Supply
Source
Switch with
External
Over-
Current
Detector
100k
FAULT
VBUS
VBUS
图5.
数字过流检测方案
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
7
IR
VCC
方向输出引脚。该引脚与CLOCK的上升沿同步，并控制着
数据总线的方向。缺省情况下，FUSB2805 保持 DIR 引脚
低电平，导致数据总线成为输入端。当DIR为低时，
FUSB2805 侦听来自链接控制器的数据。只有当存在数据
需要发送到链接器时，FUSB2805拉动DIR为高，这是因为
以下两个原因之一：
VCC为 FUSB2805 的主电源电压。当 VCC电压介于 2.7 V 与
4.5 V 之间时，FUSB2805 正常工作。VCC上的最大瞬态电
压为 5.5 V，最多持续 5 ms。可选一只100nF的退耦电
容。
PSW
该引脚为有效高、开源结构、功率开关的模拟输出。该引
脚可以连接到一个外部 VBUS开关或者一个外部充电泵启用
1. 发送USB接收数据、RX CMD状态更新和寄存器-读数据
至链接控制器
电路，用于控制外部VBUS电源。如果链接控制器处于主机
模式，可以通过将 OTG 控制寄存器中的 DRV_VBUS 和
DRV_VBUS_EXT 位设置为逻辑 1 实现。FUSB2805 将 PSW
驱动为高电平，从而启用外部 VBUS电源。如果链接控制器
检测到过流状况 (VBUS_valid=0)，应该通过将 DRV_VBUS_EXT
2. 在上电过程、复位和低耗模式下，阻止链接控制器驱
动数据总线
当 Chip_Select_N 被解除声明为高电平时，DIR 引脚还
具有三态功能。
STP
设置为 0b 禁用外部VBUS电源。使用一只外部 100 k下
拉电阻。
停止输入引脚。该信号与CLOCK上升沿同步。链接器必须
声明STP，发出一次发送数据包或一次寄存器-写操作结束
的信号。当DIR被声明时，链接控制器能够有随意地声明
STP，退出FUSB2805，使得在下一个时钟周期中DIR被解除
声明。
另外，用于控制PSW的信号极性可以通过INTF_CTRL寄存器
来更改。
VBUS
该电源 I/O 引脚用作VBUS 比较器和过流检测器的输入
端。
NXT
下次数据输出引脚。该信号与CLOCK上升沿同步。缺省
时，FUSB2805保持NXT为低。当DIR为低，且链接器正在发
送数据时，NXT被声明，通知链接器提供下一个数据字
节。当 DIR 引脚为高电平并且 FUSB2805 向链接器发送
数据，声明 NXT 以告知链接器总线上存在另一个有效字
节。NXT 不可用于寄存器读数据或 RX CMD 状态更新。
当 OTG 控制寄存器的DRIVE_VBUS设置为 1b 时，外部VBUS
电源试图驱动VBUS，使之处于电压 4.4 V 至 5.25 V 范围
内，同时输出电流能力至少为 8 mA。
VCC3V3和 VDD1V2
调节输出电压。这两种电源用于为内部数字和模拟电路供
电。
当Chip_Select_N被解除声明高时，NXT引脚还具有三态功
能。
CLOCK
CLKIN
这是一个 60 MHz 接口时钟，用于同步 ULPI 总线。该引
脚被配置为输出。作为12引脚接口实现方式，全部ULPI信
号均与CLOCK的上升沿同步。FUSB2805接受数字时钟输
入，并向链接器输出60MHz的时钟。
时钟输入引脚。CLKIN 为数字时钟输入。CLKIN 引脚的允
许频率为 19.2 MHz 和 26 MHz。该时钟所要求的频率容
差为 50 ppm。链接控制器要求 FUSB2805 能够输出 60
MHz 时钟。采用PLL可以产生该时钟，PLL的输入时钟为
CLKIN。
GND
在FUSB2805中，全局地信号作为所有电路的地，
. 19.2 MHz –CFG1 设置为低电平
. 26 MHz –CFG1 设置为高电平
Reset_N
Reset_N 为低电平有效的复位信号，具有 VIO电压。未用
时，VIO被限制到 1.8 V。典型地，限制到该产品的上电复
位信号。
CHIP SELECT_N
有效低芯片选择引脚。当声明为高时，D[0-7]、 CLOCK、
DIR、和NXT 引脚处于三态并被忽略，所有内部电路被限
电，其中包括稳压器。低电平时，FUSB2805 被唤醒，
ULPI 引脚工作转为正常。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
8
工作模式
ULPI 模式
低耗模式
通过编程，ULPI总线可以在四种不同的模式和节电模式下
工作。每种模式重新配置数据总线上的信号。若设置为多
个模式，则会出现未定义的性能。
当 USB 空闲时，链接控制器能够使得 FUSB2805 进入低
耗模式（又称为暂停模式）。为了能够进入低耗模式，链
接控制器需要将“功能控制” (FUNC_CTRL) 寄存器中的
SUSPENDM位清零为 0b。
同步模式
在低耗模式下，FUSB2805 提供有关数据总线线路状态和
中断信息，使得链接控制器能够监测基本的 USB 状态，
从 VCC 电源中导出小于 200 µA 电流。
同步模式为缺省模式。在上电过程和当 CLOCK 稳定时，
FUSB2805 进入同步模式。
在同步模式中，链接控制器必须将所有的ULPI信号与
CLOCK同步，满足动态特性表中定义的建立和保持时间。
此外，在低耗模式下，CLKIN引脚上的时钟停止，但是，
在声明STP退出低耗模式之前它必须得到重新启动。
链接控制器使用该模式，执行下列任务：
. 检测高速握手（打招呼）
一旦进入低耗模式，FUSB2805 必须保持最短 120 个时钟
周期（或 2 µs）的低耗模式。2 µs 延时后，可以通过声
明 STP 信号，退出低耗模式。然后，如果检测到任何一
个中断源出现变化，而且该变化仍然存在，则FUSB2805向
链接器发布RXCMD命令。若在退出前解除了中断状况，可
能不会被发送 RXCMD。
. 发送和接收USB数据包
. 读和写寄存器
. 接收来自FUSB2805的USB状态更新（RX CMDs）
关于进一步详情，请参阅ULPI修订版1.1规范的第3.8节。
在低耗模式下，数据总线分配发生改变，改变后如表1所
示。
表1.
在低耗模式线ULPI总线上的信号映射
信号
映射至
D0
方向
输出
输出
输出
输出
输出
说明
LINESTATE0
LINESTATE1
保留
组合LINESTATE0，直接由模拟接收器驱动
D1
组合LINESTATE1，直接由模拟接收器驱动
保留；FUSB2805驱动这些引脚为低。
D2
INT
D3
有效高中断信号。无论何时发生未屏蔽中断，均被声明和锁存。
保留；FUSB2805驱动这些引脚为低。
保留
D[7:4]
进入低耗模式
链接器设置（在功能控制寄存器中）SuspendM=0b，可
以将FUSB2805置于低耗模式。在 FUSB2805 接受该寄存
器写数据之后，CLOCK 可以停止，持续最短 5 个时钟
周期，如图6所示。当进入低耗模式时，FUSB2805 声明
DIR，并保持 NXT 为低电平。声明DIR之后，出现一个
周期的数据总线翻转，在此期间，D[7: 0]的数据无
效。一旦结束翻转周期，FUSB2805 开始驱动各个信
号，如表1所示。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
9
ULPI Signals
CLOCK
D [7:0]
DIR
TXCMD
RegWr
Turn
Around
Data
Low Power Mode Signals
tCS
1
tSTP
STP
NXT
SuspendM
Note: The second STP pulse indicates the exit of low-power (suspend) mode
图6. 进入低耗模式
退出低耗模式
如果 FUSB2805 已经被暂停持续至少 2 µs，通过异步声
明 STP，链接器向 FUSB2805 发出信号，要求退出低耗模
式。FUSB2805立即唤醒其内部电路。一旦满足ULPI时序要
求，则FUSB2805解除声明DIR，确保在DIR解除声明和设置
(功能控制寄存器中)SuspendM=1b之前，一个至少5个周期
的CLOCK被驱动。在解除声明 DIR 引脚的下一个周期中，
链接器解除声明 STP 引脚。声明 DIR 引脚后，存在一个
周期的数据总线翻转周期，在该周期内，D[7:0] 的值无
效。一旦结束翻转周期，FUSB2805开始驱动各个信号，如
表1所示。
ULPI Signals
PHY Output CLOCK
Turn
Around
D [7:0]
DIR
Synchronous Mode Signals
Low-Power Mode Signals
STP
tWU
tCD
NXT
SuspendM
图7.
FUSB2805提供输出CLOCK时退出低耗模式
还提供一个 INT 信号，将 USB 事件通知链接器。在 6
引脚串行模式中，如果链接器需要 CLOCK 运行，必须在
进入 6 引脚串行模式之前设置 CLK_SUSPENDM 寄存器位
为逻辑 1b。
6 引脚全速/低速串行模式
这种工作模式为链接器而提供， 链接器包含有继承FS/LS
功能性，并可以启用达到HS功能的高效升级路径。
为了进入 6 引脚串行模式，链接控制器将接口控制寄存
器中的 6PIN_FSLS_SERIAL 位设置为逻辑 1。为了退出 6
引脚串行模式，链接控制器声明 STP 引脚。
在 6 引脚模式下，FUSB2805 要求 CLKIN 保持运行。在
6 引脚串行模式下，数据总线分配改变，改变后如0所
示。数据包的信令范例如图24所示。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
10
表2.
6-引脚模式下ULPI总线上信号映射
信号
映射至
D0
方向
输入
输入
输入
输出
输出
输出
输出
输出
说明
TX_ENABLE
TX_DATA
TX_SE0
INT
有效高发送启用
D1
在 DP 和 DM 引脚上发送差分数据
D2
在 DP 和 DM 引脚上发送单端零(SE0)
有效高中断信号。无论何时发生未屏蔽中断，均被声明和锁存。
来自 DP 引脚上的单端接收数据
D3
RX_DP
D4
RX_DM
D5
来自 DM 引脚上的单端接收数据
RX_RCV
保留
D6
来自 DP 和 DM 引脚的上差分接收数据
保留；FUSB2805驱动这些引脚为低。
D7
还提供一个 INT 信号，将 USB 事件通知链接器。在 3
引脚串行模式中，如果链接器需要 CLOCK 运行，必须在
3 引脚全速/低速串行模式
这种工作模式被提供给链接器，链接器包含有 FS/LS 功
能性，并可以启用具有 HS 功能性的高效升级路径。
进入 3 引脚串行模式之前设置 CLK_SUSPENDM 寄存器位
为逻辑 1b。
为了进入 3 引脚串行模式，链接控制器将接口控制寄存
器中的 3PIN_FSLS_SERIAL 位设置为逻辑 1。为了退出这
种模式，链接控制器声明 STP 引脚。
在 3 引脚模式下，FUSB2805 要求 CLKIN 保持运行。在
3 引脚串行模式下，数据总线分配改变，改变后如0所
示。数据包的信令范例如图23所示。
表3.
3-引脚模式下ULPI总线上信号映射
信号
映射至
方向
说明
TX_ENABLE
DAT
D0
输入
有效高发送启用
当 TX_ENABLE 为高电平
D1
D2
I/O
I/O
时，在 DP 和 DM 引脚上发送差分数据；当 TX_ENABLE 为低电平时，在 DP 和 DM
引脚上接收差分数据
当 TX_ENABLE 为高电平
SE0
时，在 DP 和 DM 引脚上发送单端零；当 TX_ENABLE 为低电平时，在 DP 和 DM
引脚上接收单端零
INT
D3
输出
输出
有效高中断信号。无论何时发生未屏蔽中断，均被声明和锁存。
保留
D[7:4]
保留；FUSB2805驱动这些引脚为低。
. 内部电路限电；VCC总电流 < 36 μA。
电源模式
. D[0-7]、CLOCK、NXT 和DIR为三态和被忽略。STP被
忽略
FUSB2805支持两种基本的电源工作模式，包括：
. 常规模式
. 节电模式
. 为OTG PHY供电的稳压源关闭
. ULPI 接口上的下拉电阻被启用，防止总线浮动（VIO
出现）。
常规模式
当 VCC和 VIO上电，并且 Chip_Select_N 被声明时，进入
. FUSB2805 被迫进入低耗状态，忽略任何 ULPI 命
令，包括
唤醒事件。
该模式。
节电模式
当芯片选择无效时，FUSB2805进入节电模式，在此模式
中，将发生以下动作：
. 如果 VIO不存在，以 VIO为参考的那些信号不能上
电。
. Chip_Select_N 为高电平或 VIO不存在。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
11
USB 状态过渡
高速USB 主机或OTG设备能够处置不止一个电气状态，其
定义参见USB和OTG规范。通过设置XcvrSelect、
TermSelect、OpMode[1:0]、DpPulldown和DmPulldown表4
寄存器位，FUSB2805 能够适应多种状态。
表4.
工作状态和相应的寄存器设置
寄存器设置
内部寄存器设置
信令模式
通用设置
三态驱动器
XXb
01b
Xb
0b
01b
00b
Xb
1b
Xb
1b
0b
0b
0b
0b
0b
1b
0b
1b
0b
0b
上电或者 VBUS < Vth (SESS_END)
主机设置
主机招呼
00b
00b
X1b
01b
01b
10b
10b
10b
00b
0b
0b
1b
1b
1b
1b
1b
1b
0b
10b
00b
00b
00b
10b
00b
00b
10b
10b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
1b
0b
0b
0b
0b
0b
0b
1b
主机高速
主机全速
主机 HS/FS 暂停
主机 HS/FS 恢复
主机低速
主机低速暂停
主机低速恢复
Host Test_J/Test_K
外设设置
外设招呼
00b
00b
01b
01b
01b
00b
00b
00b
01b
01b
01b
00b
1b
0b
1b
1b
1b
0b
1b
0b
1b
1b
1b
0b
10b
00b
00b
00b
10b
10b
10b
00b
00b
00b
10b
10b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
1b
1b
1b
1b
1b
1b
1b
0b
1b
1b
1b
0b
1b
0b
1b
1b
1b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
0b
1b
1b
1b
1b
1b
1b
0b
1b
0b
0b
0b
1b
0b
1b
0b
0b
0b
1b
外设高速
外设全速
外设 HS/FS 暂停
外设 HS/FS 恢复
Peripheral Test_J/Test_K
OTG 器件、外设招呼
OTG 器件、外设高速
OTG 器件、外设全速
OTG 器件、外设 HS/FS 暂停
OTG 器件外设、HS/FS 恢复
OTG 器件外设、Test_J/Test_K
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
12
协议说明
ULPI总线
ULPI 参考资料
表5给出了 ULPI 引脚信号的说明。在同步模式中，全部
信号都与CLOCK同步。利用 ULPI 总线，链接控制器能够
读写寄存器、在 USB 总线上发送数据。FUSB2805 利用
ULPI 总线发送状态信息、USB 解码数据和寄存器内容至
链接控制器。在低耗和串行模式，即使时钟仍处于在运
行，所有信号与CLOCK异步。ULPI 总线用法的范例如所
示。图8
FUSB2805提供了用于与链接控制器通信的12引脚 (SDR)
ULPI接口。强烈建议， FUSB2805的用户阅读ULPI 和
UTMI+规范，清单如下：
UTMI+ 低引脚接口规范 (ULPI) 修订版 1.1，2004 年 10
月 20 日。http://www.ulpi.org
UTMI+ 规范修订版 1.0，2004 年 2 月 22 日。
http://www.ulpi.org
表5.
ULPI 信号说明
FUSB2805
信号名称
信号说明
方向
60 MHz 接口时钟。
CLOCK
OUT
如果一个时钟被接入到CLKIN引脚，FUSB2805驱动一路60MHz输出时钟。
在低耗和串行模式中，为了节能，该时钟可以被关闭，
8位数据总线
在同步（SDR）模式，缺省时，链接器驱动D0-D7为低。通过发送一个非零数据码型，称为TXCMD (发送命
令)，链接器启动传送。在同步模式下，D0-D7 方向由 DIR 引脚控制。无论 DIR 引脚值何时变化，必须
对 D0-D7 线路内容忽略整好一个时钟周期，即所谓的“翻转”周期。
D0-D7
I/O
在低耗、6-引脚以及
3-引脚串行模式中，各个数据线具有固定方向和不同的含义。
控制D0-D7数据总线的方向
在同步（SDR）模式，缺省时，FUSB2805 驱动DIR为低，使得数据总线为输入，以便FUSB2805能够侦听是
否有来自链接控制器的TXCMD命令。
只有当存在链接器需要的数据时，FUSB2805 才驱动 DIR 引脚为高电平。当 DIR 和 NXT 均为高电平
时，数据总线上的字节包含解码后的 USB 数据。当DIR 为高和NXT为低时，字节包含状态信息，称为
RXCMD（接收命令）。唯一例外是，当FUSB2805返回寄存器-读数据，其间NXT 仍为低，取代通常的RXCMD
字节。DIR每发生一次变化，在数据总线上引起一次翻转周期，在此期间内，D0-D7无效，且必须被链接
器忽略。
DIR
OUT
在低耗、6-引脚以及3-引脚串行模式中，DIR始终被声明。
停止
在同步（SDR）模式，链接器驱动STP为高，在发往FUSB2805数据的最后一个字节之后持续一个周期。链
接器能够随意地声明STP去强迫解除DIR声明。
STP
NXT
IN
在低耗和串行模式，链接器保持STP为高，用来唤醒FUSB2805，迫使ULPI总线返回到同步模式。
下次
在同步（SDR）模式，FUSB2805驱动NXT为高，用来调节数据。如果DIR为低，则FUSB2805声明NXT，告知
链接控制器在接下来的周期中去取代D0-D7上的下一个数据字节。如果 DIR 引脚为高电平，FUSB2805 声
明 NXT 引脚，告知链接控制器当前周期内 D0-D7 上存在一个有效的 USB 数据字节。如果DIR是高电
平，NXT是低电平，FSUSB会驱动RXCMD，除非读寄存器的数据在当前周期里返回给链接控制器。
OUT
在低功耗模式或者串行模式NXT不可用
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
13
Link sends
TXCMD
FUSB2805
accepts
TXCMD
Link sends
next data.
FUSB2805
accepts
Link signals
end of data
ULPI bus
is idle
FUSB2805
asserts DIR,
causing
FUSB2805
sends
RXCMD
FUSB2805
sends USB de-asserts DIR,
data causing
FUSB2805
turnaround cycle (NXT low)
(NXT high) turnaround cycle
CLOCK
D0-D7
Turn
Turn
around
TXCMD
DATA
RXCMD
around
DATA
DIR
STP
NXT
图8.
后接数据接收的ULPI通用数据发送
在上电时，FUSB2805 进行内部上电复位并声明 DIR，告
知链接器，ULPI 总线不可用。当内部 PLL 稳定时，
FUSB2805 解除声明 DIR 引脚。上电时间取决于 VCC电源
上升时间和 PLL 启动时间 (tstartPLL)。
如果Chip_Select_N被解除声明，FUSB2805保持在节电模
式，此时所有ULPI接口引脚处于三态，内部稳压器关闭，
功耗降低，甚至低于低耗模式。
如果由于不存在 VIO而进入低耗模式，建议链接器上电序
列如下：
无论何时DIR被声明，FUSB2805驱动NXT引脚为低，而且根
据RXCMD数值，必须驱动数据总线(D0-D7) 。当DIR被解除
声明时，链接器必须驱动(D0-D7)为缺省低。在开始USB数
据包之前，通过使功能控制寄存器中RESET位置位，链接
器复位FUSB2805。RESET位置位后，FUSB2805声明DIR，直
到内部复位完成为止。当复位得到完成时，FUSB2805自动
解除声明DIR，并清除RESET位。每次复位之后，RX CMD被
发送到链接控制器，更新USB状态信息。该序列完成之
后，ULPI总线做好使用准备，链接器能够启动USB工作。
1. 连接 VCC和 VIO电源。
2. Chip_Select_N由高变低，启用FUSB2805；
3. 链接器等待至少tPWRUP，忽略全部ULPI引脚状态；
4. 链接器开始监测DIR状态电平。如果检测到DIR为低，
链接器发送一次复位命令；
5. ULPI接口可以使用。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
14
VCC
VIO
Chip_Select_N
Regulator Powerup
Powerup
tPWRUP
Bus Idle
Internal PORB
CLKIN
Internal clock stable
Reset Command
tstartPLL
Clock (output)
D[7:0]
Clock Start
RXCMD
Update
TXCMD
DATA
Internal reset
DIR
STP
NXT
t1 t2
t3 t4
图9.
t5
上电、复位和总线空闲序列－ULPI 准备
t6
注意：
4. 如果 CLKIN 稳定，当 DIR 引脚解除声明时，FUSB2805 从 CLOCK 引脚驱动一路 60 MHz 时钟输出。该时钟在上图
中显示为“CLOCK（输出）”。
5. t1: VCC被施加到 FUSB2805 的时刻。
6. t3: Chip_Select_N 跳变到有效状态（低）的时刻。FUSB2805 的内部稳压器接通，ULPI 引脚变得有效（可以驱动
为高电平或低电平），但是应该在上电时间 tPWRUP过程中被忽略。
7. t4: POR脉冲（上电复位）之后，ULPI引脚被驱动为指定电平。DIR被驱动为高，接着，其它ULPI引脚被驱动为低。
8. t5: PLL 启动时间tstartPLL之后，PLL 进入稳定。CLOCK引脚开始输出60MHz时钟，DIR引脚跳变为低，而且链接器
必须驱动STP 和D[7: 0] 为低（空闲）。接着，链接器启动一个复位命令去初始化FUSB2805。
9. t6: 上电序列完成，ULPI总线接口可以使用。
VBUS 供电与过流监测
过流检测
VBUS 引脚驱动 5 V –仅外部
FUSB2805只支持外部过流检测。主机应用需要一个过流检
FUSB2805不支持内部充电泵。PSW引脚支持一路外部 VBUS
电源，该引脚为有效高（开源结构）信号， 用于控制外
部电源管理集成电路，例如OTG支持的SMPS设备。
测电路，能够在VBUS引脚上提供大于 100 mA 的电流，电
压范围为 4.75 V 至 5.25 V。
一个来自该外部电路的数字信号必须连接到 FAULT 引
脚，FAULT 引脚直接控制 PSW 引脚（如图5所示）。输入
到该引脚的信号极性可以选择，该引脚直接控制PSW。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
15
USB数据包的收发
当收发USB数据包时，有一些关于链接器和PHY处理时间的
限制，确保必须满足USB数据包间延时。这些时间决定于
USB事件和数据包格式（即带有PID或NOPID发送、发送出
错、接收出错等）。
Link sends
TXCMD
FUSB2500
accepts
TXCMD
Link sends
next data.
FUSB2500
accepts.
Link signals
end of data
ULPI bus is
idle
FUSB2500
asserts DIR,
causing
FUSB2500
sends
RXCMD
FUSB2500
sends USB de-asserts DIR,
data causing
FUSB2500
turnaround cycle (NXT low)
(NXT high) turnaround cycle
CLOCK
D0-D7
turn
turn
around
TXCMD
DATA
RXCMD
around
DATA
DIR
STP
NXT
图10.
ULPI数据包收发范例
注：
10. 关于USB数据包操作与功能的详细信息，请参考ULPI规范的第3.8.2节。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
16
USB数据包时序
USB2.0规范中定义了数据包间时序，UTMI/UTMI+规范中定
义了同步与处理延时。ULPI修订版1.1规范中定义了数据
包间时序，能够确保与USB2.0及其补码规范的兼容性。
通道延时
表6描述了延时（单位为时钟周期）， 这些延时符合
ULPI。USB总线事件根据D+和D-测量得到。ULPI时序均相
对于时钟边沿，在边沿上检测信号跳变（即在时钟边沿检
测到STP）
表6.
通道延时
参数名称
HS PHY FS PHY 延 LS PHY 延
定义
延时
时
时
检测到内部 USB 总线状态发生一次变化后到 ULPI 总线上一
个 RXCMD 字节被发送之间的时钟数目。适用于所有变化，SE0
除外。
RXCMD 延时 (J/K)
4
4
4
USB 总线状态之间的时钟数告知 SE0 引脚正在通过 ULPI 总
线发送 RXCMD 字节。由于需要进行过滤，延迟时间增加。
RXCMD 延时 (SE0)
TX 开始延时
4
4 至 6
16 至 18
74 至 75
在ULPI 总线上FUSB2805检测到一次TXCMD与在USB总线上发送
SYNC码型的第一个K之间的时钟数目
1 至 2
6 至 10
在ULPI 总线上FUSB2805检测到STP与在USB总线上完成EOP发送
之间的时钟数目。
在USB总线上，当全部8个连续的"1"已经结束发送，则HS EOP
TX 结束延时
2 至 5
NA
NA
完成。
（数据包）
STP被声明后的多个时钟周期后，FS/LS数据包完成。链接器必
须寻查表示SE0-to-J 跳变的RXCMD字节，以便确定USB总线上
发送完成的时间。
HS SOF数据包具有一个较长的EOP。在发送下一个数据包之
前，链接器必须等待至少9个时钟周期或等待一次表示静噪
(LINESTATE=00b)的RXCMD。
TX 结束延时 (SOF)
RX 开始延时
6 至 9
NA
NA
NA
NA
在USB 总线上SYNC码型的第一个K被发现后到同时声明DIR和
NXT或表示RxActive 的RXCMD之间的时钟数目。仅仅用于HS数
据包。
3 至 8
对于FS/LS数据包，链接器必须查寻表示J-to-K 跳变的
RXCMD。
EOP出现在USB总线之后到FUSB2805解除声明DIR或表示RXCMD
字节中RxActive低之间的时钟数目。
在USB总线上，当全部8个连续的"1"已经结束发送，则HS EOP
RX 结束延时
3 至 8
17 至 18
122 至 123 完成。
USB 总线上开启 SE0 后，出现 FS/LS EOP。对于 FS/LS，链
接器使用 LINESTATE，而非 RxEnd delay 为 USB 数据包计
时。
注：
11. 关于PHY通道延时的详情，请参考ULPI修订版1.1规范的第3.8.2.6.2节
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
17
链接器决策时间
时钟周期数量需要分配给链接器，对一个已经接收的数据包作出响应，并正确接收背对背数据包，时钟周期数量如表7
所示。
表7.
链接器决策时间
HS PHY
延时
FS PHY
延时
LS PHY
延时
参数名称
定义
对于第二个数据包，在驱动TXCMD之前，主机链接器必须等待的时钟数目。
在HS模式中，从STP声明开始，链接器开始为第一个数据包计数。
发送-发送
15 至 24
7 至 18 77 至 247
在FS模式中，从表示LINESTATE 的RXCMD已经完成SE0-to-J 跳变开始，链接
器开始为第一个数据包计数。给定的时序确保数据包间延时为2.0 到6.5 位
的时间。
（仅适用于主机）
为发送数据包，在驱动TXCMD之前，链接器必须等待的时钟数目。
在HS模式中，从接收数据包结束（DIR解除声明，或表示RxActive为低的
RXCMD）时开始，链接器起始计数。
接收-发送
1 至 14
7 至 18
16 至 18
（主机或外设）
在FS/LS模式中，连接器从表示LINESTATE 已经完成SE0-to-J 跳变的RXCMD
开始为接收数据包计数。给定的时序确保数据包间延时为2.0 到6.5 位的时
间。
接收-接收
1
1
1
连续接收数据包间的最小时钟数目。链接器必须能够接收连续两个数据包。
（仅适用于外设）
发送-接收
主机或外设发送一个数据包，在该时钟周期数目后，如果没有接收到任何响
应，则认为超时。该时间之后，可以进行任何后续发送。
92
80
718
（主机或外设）
USB Inter Packet Delay (8 to 192 HS bit times)
DP or
DATA
DM
SYNC
EOP
IDLE
CLOCK
turn
around
DN-4
DN-2
DN-1
DN
TXCMD
D0
DN-3
D1
D0-D7
DIR
STP
NXT
RX End Delay
( 3 to 8 clocks)
Link Decision Time (1 to 14 clocks)
TX Start Delay
(1 to 2 clocks)
图11.
HS 接收转向发送数据包时序的，范例1
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
18
USB Inter Packet Delay (88 to 192 HS bit times)
DP or
DM
SYNC
DATA
EOP
IDLE
CLOCK
D0-D7
DN-1
TXCMD
D0
DN
D1
DIR
STP
NXT
TX End Delay ( 2 to 5 clocks)
Link Decision Time (15 to 24 clocks)
TX Start Delay
(1 to 2 clocks)
图12.
HS发送转向发送数据包时序的范例2
序文
包之前，FUSB2805 按照FS位率自动发送一个序文头信
息。FUSB2805确保在FS PRE_PID的末位与LS SYNC的首位
之间最短间隔为4个FS位时间。发送 PRE-PID 后，
FUSB2805 驱动 J-state 状态至少一个 FS 位时间，然后
电阻在总线上保持 J-state 状态。在序文模式下，
FUSB2805 还可以从 FS 总线接收 LS 数据包。图13显示
一个序文数据包的范例。
序文数据包为要求通过主机与集线器之间FS总线传输的低
速数据包的头信息。为进入序文模式，链接器必须设置
FUNC_CTRL控制寄存器中XCVRSELECT[1:0]=11b，在这种模
式（序文）下，FUSB2805工作在FS模式，所有发送的数
据，具有FS上升和下降时间特性。链接器无论何时采用序
文模式发送一个USB数据包，则在以低速位率发送该数据
IDLE
(4 FS bits
min)
FS
SYNC
FS
PRE_ID
LS
SYNC
DP or
DM
LS PID
LS D0
LS D1
CLOCK
D0-D7
TXCMD (LS PID)
D0
D1
DIR
STP
NXT
图13.
序文序列
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
19
RXCMD 和 TXCMD
ULPI 修改原始的UTMI 数据流，使之能够适合更多的数据
类型。在发送过程中，PID字节冗余过装载有ULPI发送命
令(TXCMD)。接收流中未用的数据过装载有接收命令
(RXCMD)。ULPI定义一个由链接器发出的发送命令字节和
一个由FUSB2805发出的接收命令字节。
发送命令(TXCMD)
通过发出发送命令 (TXCMD) 字节，链接器启动向
FUSB2805 传送，如表8所示。TXCMD由2位命令代码和6位
有效负载构成。
表8.
来自链接器到 FUSB2805 的发送命令（TXCMD）
命令代码 命令净负
命令类型描述符
说明
[7:6]
荷 [5:0]
00 0000b
(NOOP)
空闲。00h 表示ULPI总线的空闲状态。
连接器缺省驱动NOOP。
IDLE
00b
XX XXXXb
保留命令空间。取值不同于上述值时产生未定义的动作。
00 0000b
(NOPID)
发送不带PID（数据包PID）的USB数据，例如招呼和恢复信号。
FUSB2805开始在USB上发送下一个数据字节。
TRANSMIT
01b
00 XXXXb
(PID)
发送USB数据。D[3:0]表示USB数据包识别符PID[3:0]。
XX XXXXb
(RSVD)
保留命令空间。
取值不同于上述值时产生未定义的动作。
10 1111b
(EXTW)
扩展寄存器写命令（任选）。该命令接受后，8位地址必须出现在下一
个时钟周期。
REGISTER WRITE
REGISTER READ
10b
11b
XX XXXXb
(REGW)
带有6位立即地址的寄存器写命令。
10 1111b
(EXTR)
扩展寄存器读命令（任选）。
该命令接受后，8位地址必须出现在下一个时钟周期。
XX XXXXb
(REGR)
带有6位立即地址的寄存器读命令。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
20
接收命令(RXCMD)
DIR声明后，FUSB2805采用接收命令(RXCMD) 字节，通过
ULPI数据总线来更新链接器在线状态、USB接收、断线和
OTG信息。
无论何时RXCMD的任何数据字段出现变化，FUSB2805自动
发出一个RXCMD。链接器必须能够在任何时刻，包括NXT为
低时在USB接收数据包的任何时刻，能够接受一个RXCMD，
包括单一或多个（背靠背）RXCMD。
表9.
RXCMD 数据字节格式
DATA
状态名称
说明
[7:0]
[1:0]
线路状态信号：
D[0]: LINESTATE0
D[1]: LINESTATE1
LINESTATE
LINESTATE[1:0]反应DP与DM引脚的当前状态，为多种寄存器设置的函数，而且不论该
设备为主机还是外设。详细的编码和说明如表10和表11所示。
编码后VBUS电压状态： 这种编码用于过流检测、会话开始和会话申请。Sess_End 与
Sess_Vld 指示符为来自内部FUSB2805VBUS 比较器的信号。编码后VBUS 状态为：
数值
00b
01b
10b
11b
VBUS电压
Sess_End
Sess_VLD
A_VBUS_VLD
VBUS < VB_Sess_End
1
0
X
X
0
0
1
X
0
0
0
1
[3:2]
VBUS状态
VB_Sess_End ≤ VBUS < VA_Sess_Vld
VA_Sess_Vld ≤ VBUS < VA_VBUS_Vld
VBUS ≥ VA_VBUS_VLD
RxEvent 编码:RXCMD的这个编码字段用于通知链接器在USB 总线上接收到了数据包。
数值
00b
01b
10b
11b
RxError
RxActive
HostDisconnect
0
0
X
1
0
1
X
1
0
0
1
0
[5:4]
RxEvent
[6]
[7]
ID
该位反应ID引脚的状态。ID_PULLUP 置位1b的50ms后该位有效。
缺省时未用该可选中断位。链接器可以随意地启用PWR_CNTRL 控制寄存器中的
BVALID_RISE 和/或BVALID_FALL位。如果ALT_INT位被声明，BVALID中的相应变化将
使得一次RXCMD被发送到链接器
ALT_INT
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
21
线路状态编码
如表9所述，发送到链接器的 LINESTATE[1:0] 是该端口
是否为朝向上游（外设）或下游（主机）的函数。依赖其
模式，双用OTG设备必须选择正确的LINESTATE编码。说
明：配置成LS外设（朝向上游端口），带有DM上拉时，不
受FUSB2805支持。
表10. 上游（外设）朝向端口的LINESTATE[1:0]编码，DP_PULLDOWN=0b
模式
数值
全速
01, 11
1
高速
00
招呼
XCVRSELECT[0:1]
TERMSELECT
00
0
1
00b
01b
SE0
Squelch
Squelch
(! Squelch) 和
FS-J
! Squelch
(HS_Differential_Receiver_Output)
LINESTATE[1:0]
(! Squelch) 和 (!
10b
11
FS-K
SE1
无效
无效
HS_Differential_Receiver_Output)
无效
注意：
12. (! Squelch)表示无效静燥。
13. (! HS_Differential_Receiver_Output) 表示无效的HS_Differential_Receiver_Output。
表11. 下游（主机）朝向端口的LINESTATE[1:0]编码，DP_PULLDOWN and DM_PULLDOWN=1b
模式
数值
低速
10
全速
01, 11
1
高速
00
招呼
XCVRSELECT[0:1]
TERMSELECT
00
0
1
0
OPMODE[1:0]
X
X
00, 01 or 11 10
00b
01b
SE0
SE0
Squelch
Squelch
(! Squelch) 和
LS-K
FS-J
! Squelch
(HS_Differential_Receiver_Out
put)
LINESTATE[1:0]
(! Squelch) 和
(!
10b
11
LS-J
SE1
FS-K
SE1
无效
无效
HS_Differential_Receiver_Outp
ut)
无效
注意：
14. (! Squelch)表示无效静燥。
15. (! HS_Differential_Receiver_Output) 表示无效的HS_Differential_Receiver_Output。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
22
VBUS 电压状态编码
如表9所述， VBUS状态编码发生变化将向链接器发出一次
RXCMD。为了确保链接器能够接收VBUS状态变化，链接器
必须首先启用USB_INTR_EN_R和USB_INTR_EN_F寄存器中相
应的中断。链接器根据典型配置（主机、外设、OTG 设
备）利用指示信号进行操作。表12显示根据配置 RXCMD
中的 VBUS指示信号。
器应用规范适用。OTG A-device 还采用 SESS_VLD 来检
测 OTG B-device 何时启动 VBUS脉冲 SRP。这种外部充电
泵的控制可以通过PSW引脚来实现。
RxEvent 编码
如表9所示，该编码为链接器提供有关 USB 总线上接收到
的数据包的信息。主要编码包括 RxActive、RxError 和
HostDisconnect。
表12. RXCMD 中的VBUS指示信号
配置
A_VBUS_VL
D
SESS_
VLD
SESS_
END
RxActive
当FUSB2805在USB总线上检测到SYNC码型，它向链接器发
出一次RxActive事件的信号。RxActive事件通信方法有两
种：
标准主机
标准外设
是
否
是
否
否
是
是
是
否
否
否
是
. FUSB2805同时声明DIR和NXT；或
OTG A-Device
OTG B-Device
. 当RxEvent 位中的RxActive 字段设置为1b 时，
FUSB2805 向链接器发出一次RXCMD命令。
对于标准的USB主机控制器应用，以下方面适用：
供电范围为 4.75V ≤ VBUS≤ 5.25 V，系统必须
能够提供 500 Ma 电流。
链接器必须能够检测这两种方法，而且RxActive对接收信
息进行成桢操作，从第一个字节到最后一个字节。还需认
定的是，当在RXCMD中指定时或当DIR解除声明时，
RxActive 设置为0b。
.
. 采用外部电路检测过流条件。如果外部电路检测
器能够提供一个数字故障信号，该信号必须连接到FAULT
链接器还要利用RxActive，为高速数据包定时，确保总线
输入引脚，而且链接器必须完成以下工作：
翻转时间满足要求。
1. 根据外部故障信号的极性，设置NTF_CTRL寄存器
中的IND_COMPL位为0b 或1b。
RxError
在接收USB数据包过程中，如果FUSB2805检测到一次出错
时，通过将RxError 字段设置为1b，FUSB2805解除声明
NXT，并发送一次RXCMD。接收到的数据包不再有效，必须
被链接器丢掉。
2. 设置OTG_CTRL 寄存器中的USE_EXT_VBUS_IND位
为1b。
3. 如果没有必要采用内部A_VBUS_VLD 比较器来校
验故障指示符，设置INTF_CTRL寄存器中的
IND_PASSTHRU位为1b。
HostDisconnect
仅当 FUSB2805 配置为主机
(DP_PULLDOWN={0}DM_PULLDOWN=1b) 时，该编码有效。该
编码能够向主机控制器表示何时一个外设被连接 (0b) 或
断线 (1b)。主机控制器必须通过分别设置USB_INTR_EN_R
和USB_INTR_EN_F 寄存器中的HOST_DISCON_R 和
HOST_DISC_F 位启用HostDisconnect。HostDisconnect变
化将引起FUSB2805向链接器连同更新值一起发送一次
RXCMD。
对于标准的USB外设控制器应用，标准外设检测何时
VBUS处于足够工作电平。必须启用SESS_VLD来检测USB外
设工作的开始和结束。对于标准外设而言，无需检测
A_VBUS_VLD 与SESS_END阈值。
对于配置成OTG B-device的设备，必须采用SESS_VLD检测
何时VBUS处于足够工作电平。必须采用SESS_END何时VBUS
跌至一个低电平，允许B-device安全地启动VBUS脉冲
SRP。
在外设模式，HostDisconnect必须被忽略，而且不许屏蔽
关于RxActive 或RxError的事件
关于RXCMD 和TXCMD 操作与功能的详情， 请参阅ULPI规
范的第3.8.1节。
对于配置成 OTG A-device 的设备，必须能够为 VBUS引脚
提供超过最小 8 mA 的电流。此 8 mA（最小）电流为提
供给 FUSB2805 的外部电流。如果外部充电泵电源提供的
电流超过 100 mA， 则必须采用过流电路，并且主机控制
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
23
寄存器读写操作
根据需要，采用TXCMD字节，链接器能够读写寄存器字
节、置位或清除寄存器位。FUSB2805支持立即和扩展寻址
寄存器操作，对于链接器可任选扩展寻址寄存器。如果在
一次操作中，FUSB2805声明了DIR，该寄存器操作失败。
如果寄存器操作失败，链接器必须再次尝试，直到成功为
止。
终覆盖该寄存器读。(参见ULPI 修订版1.1规范的第
3.8.3.5节)。如果通过提前声明DIR，FUSB2805 退出
RegRead，当总线空闲时链接器还须再次尝试RegRead。
对于一次EXTW（扩展寄存器写），地址设置为2Fh，链接
器发送一次寄存器-写命令，等待NXT被声明。在NXT被声
明的随后周期，链接器发出扩展寄存器地址，并等待NXT
再次被声明。当NXT第二次声明时，链接器发出扩展寄存
器地址，并等待NXT再次被声明。当NXT第三次被声明时，
在随后周期中链接器声明STP，完成该操作。如果通过声
明DIR，FUSB2805 退出RegRead，当总线空闲时链接器还
须再次尝试RegRead。
立即寄存器读写
采用所需寄存器地址，通过首次发出TXCMD字节作为
RegRead 或RegWrite 命令，可以立即该访问寄存器。
对于RegRead，链接器发出读命令请求，并等待NXT被声
明。在 NXT 声明后的周期中，FUSB2805 声明 DIR，从而
获取总线控制权。在 DIR 声明后的周期中，FUSB2805 必
须返回寄存器读数据。如果在寄存器读操作中，包括在寄
存器读数据正在被返回的时期，DIR被声明，FUSB2805不
会声明NXT， 这样才能确保在任何周期中USB接收事件始
终覆盖该寄存器读。(参见ULPI 修订版1.1规范的第
3.8.3.2节)。如果通过提前声明DIR，FUSB2805 退出
RegRead，当总线空闲时链接器还须再次尝试RegRead。
对于背对背的扩展读和USB接收信号的详情和时序波形，
参考ULPI规范的第3.8.3.5节。
关于寄存器读写操作与功能的详情，请参阅ULPI规范的第
3.8.3节。
退出ULPI传送
有两种方法可以退出ULPI传送：
对于RegWrite，链接器发出写命令请求，并等待NXT被声
明。在NXT声明的随后周期，链接器发出寄存器写数据，
并等待NXT被再次声明。当NXT第二次声明时，在随后周期
中链接器声明STP，完成本次操作。在FUSB2805接受另一
次发送命令之前，它必须检测STP声明。如果通过声明DIR
使得FUSB2805退出RegWrite，当总线空闲时链接器还须再
次尝试RegWrite。
. 链接器由 FUSB2805 退出
. FUSB2805由链接器退出
链接器由FUSB2805退出
当链接器正在传送数据时，通过声明DIR，FUSB2805能够
使链接器退出。
对于背对背的读/写以及USB接收信号的详情和时序波形，
参考ULPI规范的第3.8.3.3节。
FUSB2805由链接器退出
当FUSB2805已经声明DIR时（在同步模式中），通过声明
STP，链接器可以退出。在时序图中，需要满足非常具体
的标准，才能保证链接器操作，这与 STP 得到声明的周
期相关，该 STP 由链接器声明，以申请退出 FUSB2805
（关于时序的详情，请参阅 ULPI 修订版 1.1 规范的第
3.3.4.2 节）。尽管该特征可以在任何时候使用，还可以
通过禁用FUSB2805而终止"模糊不清的"端口。如果在USB
接收数据包过程中链接器声明了STP，在当前数据包和下
一个数据包过程中，FUSB2805不能担保USB数据的有效
性，
扩展寄存器读写
扩展寄存器读(EXTR)和写(EXTW)的含义是地址在下一个时
钟周期中可用。访问立即地址2Fh指访问一次扩展寄存器
组。
对于一次EXTR（扩展寄存器读），地址设置为2Fh，链接
器发送一次寄存器-读命令，等待NXT被声明。在NXT被声
明的随后周期，链接器发出扩展寄存器地址，并等待NXT
再次被声明。当 NXT 再次声明时，FUSB2805 声明 DIR，
获取总线控制权。在 DIR 声明后的周期中，FUSB2805 必
须返回寄存器读数据。如果在寄存器读操作中，包括在寄
存器读数据正在被返回的时期，DIR被声明，FUSB2805不
会声明NXT， 这样才能确保在任何周期中USB接收事件始
关于退出ULPI传送的详情，请参阅ULPI规范的第 3.8.4
节。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
24
USB 高速检测握手（招呼）
检测序列包括 USB 复位和 HS 检测握手（“招呼”），
并包括下列事件序列：
3. 主机招呼响应–如果主机没有检测到外设招呼，它必
须持续地声明SE0，直到复位结束为止。如果主机检
测到外设招呼响应，持续时间不大于 2.5 µs，然后
在总线释放 chirp-K 不大于 100 µs，主机发出一个
TXCMD(NOPID) 命令，其中 chirp-Ks 与 chirp-Js
呈现交替序列。每个 chirp-K 或 chirp-J 持续时间
不小于 40 µs 且不大于 60 µs。
1. USB复位- 主机检测外设插入/接入（LS ：如果DM 为
高; FS：如果DP 为高）。如果检测到LS，主机不再
继续后面的事件序列。如果检测到一个FS外设， 通
过写FUNC_CTRL、并设置XCVRSELECT[1:0]=00b (高
速)以及TERMSELECT=0b，主机可以复位该外设，其中
TERMSELECT=0b可以在总线上驱动一次SE0 (通过45
Ω，DP 和 DM 连接至 GND) 主机还可以设置
OPMODE[1:0]=10b，用于正确地招呼接收与发送。SE0
的起始点被定义为T0时刻。外设FUSB2805声明DIR，
并通过采用一次RXCMD命令将LINESTATE充电通知链接
器。
4. 高速空闲响应 – 外设必须检测一个最短 K-J-K-J-
K-J，且每个招呼检测至少持续 2.5 µs。检测到最短
招呼序列后，外设设置ERMSELECT=0b 和
OPMODE[1:0]=00b。外设工作在高速模式下，检
测!squelch (LINESTATE=01b)。当外设检测到静噪
(LINESTATE=10b)，它能够识别：主机已经完成招
呼，并等待HS USB传输开始。在发送招呼序列后，主
机修改OPMODE[1:0]=00b，并开始发送数据包。
注：
16. 主机还必须重视，在接收招呼信号、高速差分接
收输出，防止出现错误的总线活动。
图14中给出了 USB 复位和 HS 招呼序列
2. 外围招呼响应 - 检测到 SE0 后不超过 2.5µs，
如果 HS 可用，外设设置 XCVRSELECT[1:0]=10b
与 OPMODE[1:0]=10b，在 TXCMD (NOPID) 命令
之后，立即发出。这意味着，复位时间T0之后，
一次chirp-K的发送不短于1ms，结束不大于
7ms。如果外设处于低耗模式，必须在 5.6 ms
之内唤醒时钟，留出 200 µs 用于链接器开始发
送 chirp-K，并留出 1.2 ms 用于 chirp-K 完
成（基于最坏情况 10% 慢时钟）。
关于HS检测时序的详情，请参阅ULPI修订版1.1规范的第
3.8.5.1节。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
25
ULPI HOST
HS Detection Handshake (chirp)
USB Reset
Host
Responds
(chirp)
FS/LS
Detect
Host
Drives
Peripheral
Responds
(chirp)
HS
Idle
t0
SE0
TXCMD
RegWr
TXCMD
NOPID
TXCMD
RegWr
00
K
J
…..
K
K
J
D0-D7
DIR
NXT
STP
01 (FS)
00 (HS)
XcvrSelect
TermSelect
OpMode
00
(Normal)
00
(Normal)
10 (chirp)
Squelch
(00b)
Peripheral Chirp-K
(10b)
Host Chirp-K/J
(10b/01b)
SE0
(00b)
Squelch
(00b)
J (01b)
LineState
ULPI Peripheral
RXCMDs
J
SE0
TXCMD
RegWr
TXCMD
NOPID
TXCMD
RegWr
K
K
...
K
00
K
00
K
J
K
J
D0-D7
DIR
NXT
STP
XcvrSelect
01 (FS)
00 (HS)
TermSelect
OpMode
00
(Normal)
00
(Normal)
10 (chirp)
Squelch
(00b)
Peripheral Chirp-K
(10b)
Host Chirp-K/J
(10b/01b)
Squelch
(00b)
SE0
(00b)
!Squelch
(01b)
J (01b)
LineState
USB Signals
D+
D-
图14.
USB复位和HS招呼握手时序
注：
17. 时序没有按照比例。没有给出全部的RXCMD更新或总线翻转周期。对于DIR的声明和解除声明后，还应该包括一个总
线翻转周期。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
26
USB 暂停与恢复
本节描述了暂停和恢复功能、何时由主机或集线器
中的 SUSPENDM，外设设置 FUSB2805 进入低耗模
（hub）启始以及随后如何唤醒下游外设。
式，FUSB2805 只导出暂停电流。主机或许受到限电
。
全速暂停和恢复
3. 恢复 K – 当主机希望唤醒外设时，主机会设置
OPMODE[1:0]=10b 并持续发送 K-state 状态至少
20 ms。外设链接器检测 LINESTATE 上的 resume-
K，并声明 STP 以唤醒 FUSB2805。
对于采用 FUSB2805 的主机和外设， 事件序列描述如
下，并如图15所示。
事件序列：
1. FS 通信–在最初，在USB总线上， 主机和外设正在
发出FS(XCVRSELECT = 01b)。主机启用本身 15 kΩ
下拉电阻 (DP_PULLDOWN = DM_PULLDOWN = 1b)，并
禁用 45 Ω 终端。外设启用 1.5 kΩ 上拉电阻，连
接至 DP 以获得全速，或者连接至 DM 以获得低速
（TERMSELECT 设置为 1b）。
4. EOP（数据包结束）–当STP被声明时， 以LS位率，
主机侧的FUSB2805自动附加一次EOP(数据包结束)，
占SE0的两位，后随J-state状态1位。鉴于
DP_PULLDOWN和DM_PULLDOWN为主设置为1b，主机侧的
FUSB2805知道附加EOP。当一次EOP完成时，主机链接
器设置OPMODE[1:0]=00b，用于常规FS工作。外设链
接器检测到EOP，并恢复常规的FS工作。
2. 暂停–如果外设检测到没有总线活动，持续 3 ms，
则进入“暂停”状态。通过清除 FUNC_CTRL 寄存器
ULPI HOST
in FS Mode
XCVRSELECT[1:0]=01b (FS), DP_PULLDOWN=1b, DM_PULLDOWN=1b, TERMSELECT=1b
FS Traffic
FS Traffic
FS Suspend
Resume-K
EOP
TXCMD
RegWr
TXCMD
NOPID
K
K
…..
K
TXCMD
D0-D7
DIR
NXT
STP
00
(Normal)
00
(Normal)
10 (chirp)
OpMode
J
K
J
SE0
LineState
ULPI Peripheral
in FS Mode
XCVRSELECT[1:0]=01b (FS) , DP_PULLDOWN=0b, TERMSELECT=1b
CLOCK
TXCMD
RegWr
TXCMD
RegWr
LINESTATE J
LINESTATE K
TXCMD
J
D0-D7
DIR
SE0
NXT
STP
XcvrSelect
01 (FS)
00 (HS)
00
(Normal)
00
(Normal)
10 (chirp)
OpMode
SuspendM
J
K
J
J /K
SE0
LineState
USB Signals
D+
D-
图15.
FS暂停与恢复时序（时序没有按照比例）
注：
18. 时序没有按照比例。没有给出全部的RXCMD更新或总线翻转周期。对于DIR的声明和解除声明后，还应该包括一个总线翻转周期。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
27
高速暂停和恢复
对于采用 FUSB2805 的主机和外设， 事件序列描述如
下，并如图16所示：
FUSB2805只导出暂停电流。主机主机还促使
FUSB2805 进入 FS 模式(XCVRSELECT[1:0]=01b)，禁
用45 Ω 终端 (TERMSELECT=1b)，可能掉电或者不掉
电。
事件序列：
1. FS 通信–最初，主机和外设都处于空闲。主机启用
本身 15 kΩ 下拉电阻 (DP_PULLDOWN =
DM_PULLDOWN = 1b)，并禁用 45 Ω 终端
(TERMSELECT = 0b)。外设启用 45 Ω 终端
(TERMSELECT = 0b)。
3. 恢复 K – 当主机希望唤醒外设时，主机会设置
OPMODE[1:0]=10b 并持续全速发送 K-state 状态至
少 20 ms。外设链接器检测 LINESTATE 上的
resume-K (10b)，并声明 STP 以唤醒 FUSB2805。
4. HS 通信–主机链接器设置 HS
2. FS 暂停 - 如果外设检测到没有总线活动，持续 3
ms，则进入暂停状态。外设链接器设置 FUSB2805 进
入 FS 模式 (XCVRSELECT[1:0] = 01b)，禁用 45 Ω
终端，并启用 DP 上的 1.5 kΩ 上拉电阻
(XCVRSELECT[1:0]=00b) 并启用其 45 Ω 终端
(TERMSELECT=0b)。外设链接器检测 LINESTATE 上的
SE0，设置 HS 模式(XCVRSELECT[1:0]=00b)，并启用
45 Ω 终端 (TERMSELECT=0b) 主机链接器设置
OPMODE[1:0]=00b，用于常规 HS 工作。
(TERMSELECT = 1b)。通过清除FUNC_CTRL寄存器中的
SUSPENDM，外设设置FUSB2805进入低耗模式，
ULPI HOST
in HS Mode
DP_PULLDOWN=1b, DM_PULLDOWN=1b
HS Traffic
Resume-K
HS Traffic
FS Suspend
TXCMD
RegWr
TXCMD
RegWr
TXCMD
RegWr
TXCMD
NOPID
K
K
…..
K
TXCMD
D0-D7
DIR
NXT
STP
00
XcvrSelect
TermSelect
00(HS)
01 (FS)
00
(Normal)
00
(Normal)
10 (chirp)
OpMode
!squelch
(01b)
squelch
(00b)
squelch
(00b)
!squelch
(01b)
FS J
FS K
LineState
ULPI Peripheral
in FS Mode
DP_PULLDOWN=0b
CLOCK
SE0
TXCMD
RegWr
TXCMD
RegWr
TXCMD
RegWr
LINESTATE J
LINESTATE K
TXCMD
D0-D7
DIR
NXT
STP
XcvrSelect
00 (HS)
01 (FS)
00 (HS)
00
(Normal)
00
(Normal)
10 (chirp)
OpMode
TermSelect
SuspendM
LineState
FS K
(10b)
!squelch
(01b)
Squelch
(00b)
FS J
(01b)
squelch
(00b)
!squelch
(01b)
USB Signals
D+
D-
图16.
HS暂停和恢复时序
注：
19. 时序没有按照比例。没有给出全部的RXCMD更新或总线翻转周期。对于DIR的声明和解除声明后，还应该包括一个总线翻转周期。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
28
远程唤醒
FUSB2805支持能够发起远程唤醒的外设。当进入USB暂停
模式，外设记起其原来工作的速度。根据原来工作速度，
链接器遵循下面描述的协议之一：
5. 在检测远程唤醒1ms时间内，主机接管恢复驱动 （
resume driving）。
6. 外设停止驱动恢复（driving resume）
事件序列为：
7. 外设识别能够识别在持续驱动恢复的主机，
1. 假定主机与外设处于低耗模式；
8. 主机停止驱动，FUSB2805自动附件EOP作为恢复的结
2. 通过再次启用时钟并设置它的 SUSPENDM bit=1b，
外设开始远程唤醒；
束 外设将 EOP 识别为恢复
结束。
3. 在总线上，外设开始驱动一次K-state，用来恢复。
外设链接器必须做到：在发送时，LINESTATE 为K
(01b)（由于它没有收到任何RXCMD命令）。
9. 通过写OPMODE[1:0]=00b，主机与外设恢复到常规工
作。如果主机或外设之前就已经处于HS模式，在EOP
的SE0完成之前，它必须恢复到HS模式。在LINESTATE
表示SE0后，通过写XCVRSELECT[1:0]=00b 和
TERMSELECT=0b，上述操作可以实现。
4. 主机识别该恢复，再次启用其时钟，并设置它的
SUSPENDM位。
图17中给出了远程唤醒时序。
ULPI Peripheral
Remote Wake Up Timing
TXCMD
NOPID
TXCMD
RegWr
TXCMD
RegWr
D [7:0]
DIR
Linestate
RXCMD
RXCMD
RXCMD
00h
NXT
STP
XcvrSelect
00 (HS), 01 (FS) or 10( LS)
00 (HS only)
TermSelect
OpMode
Termselect = 0b for HS only
10 (chirp)
00
(Normal)
TermSelect=1b
ULPI Host
D [7:0]
TXCMD
RegWr
TXCMD
NOPID
TXCMD
RegWr
Linestate
00h
DIR
STP
NXT
XcvrSelect
01 (FS) or 10( LS)
00 (HS only)
Termselect = 0b for HS only
TermSelect
OpMode
00
(Normal)
10 (chirp)
USB Signals
D+
D-
1
8
4
5
6
7
9
2
3
T1
LS EOP Interval
图18.
低耗模式下的远程唤醒
注：
20. 时序没有按照比例。没有给出全部的RXCMD更新或总线翻转周期。对于DIR的声明和解除声明后，还应该包括一个总线翻转周期。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
29
在某些移动应用中，系统时钟 CLKIN 可以关闭， 能够节
省电池能量。实际上，设置设备进入“深度睡眠”模式。
在这种情况下，远程唤醒事件不能够启动CLKIN或后续的
内部PHY时钟，也就不能在要求的1ms时期内，向具有远程
唤醒能力的设备发出恢复信号。
号。这可以视为“轻度睡眠”模式，此时，PHY 被暂停，
内部 PLL 和时钟树被限电，但是系统中 CLKIN 运行的功
率可以得到消散。
然而，如果设计使得CLKIN也限电，则最大可能的唤醒时
间要花费超过1ms，才能退出暂停（低耗）模式。在此情
况下，要求FUSB2805能够内部驱动resume-K，直到PHY时
钟恢复为止并接收来自链接器的一个TXCMD 命令(NOPID
字节)为止。 如果时钟已经恢复，链接器接管resume-K信
号，保持具有远程唤醒能力的外设一直清醒。在退出低耗
模式之前，FUSB2805负责恢复suspendM寄存器的设置为
1b。该时钟唤醒花费的时间表示为定时参数
为顺应这种能力，FUSB2805具有自恢复特性。
自动恢复
当USB主机检测到来自下游外设（或集线器）的远程唤醒
信号（resume-K)时， 主机必须在1ms之内接管resume-K
信号 （参见USB2.0 规范第7.1.7.7节和第7.12节）。
tSTART_HOST。
根据系统的体系结构，FUSB2805可以使用自恢复特性。当
FUSB2805被配置成主机且处于暂停时，CLKIN在运行。退
出低耗模式的STP声明导致PHY时钟在1ms之内再次启动。
为了响应远程唤醒事件，链接器能够立即控制该恢复信
根据表18，可以启用或禁用自恢复特性。自恢复特性如图
20所示。
VIO = 1.8V
CLKIN Preparation3
TCLKIN_PREP
CLKIN
LINK Wakeup1
Clock Wakeup
TSTART_HOST
TSTART_LINK
CLOCK
D0-D7
turn
around
TXCMD
NOPID
K
K
K
Low Power Mode
DIR
STP
NXT
SuspendM
D+/D-
Resume-K
Idle-J
Host PHY automatically takes over driving resume-K
Downstream
Peripheral
drives
Link drives resume-K
PHY stops
autoresume
Remote
Wakeup2
1 Link Wakeup time is a function of the application implementation response to LINESTATE[1:0], the time for CLKIN to become active
and for the Link to assert STP within the system. This time needs to meet the UTMI+ and ULPI Specification.
2 The time from the remote wakeup being signaled and the FUSB2500 driving resume-K is of the order of tens of nanoseconds
3 The TCLKIN_PREP is the time for CLKIN to have become active prior to STP going high. This always has to be greater than zero
图20.
自动恢复信号
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
30
SYNC 或EOP非自动产生的数据包
在ULPI规范中，该功能可任选，但是得到了FUSB2805的支
持。该功能允许链接器关断SYNC 和EOP自动产生SYNC 和
EOP数据包。这只是关于HS 数据包数据。它的提供是用于
退步兼容，适用于那些在发送数据包时数据有效负载中包
含SYNC和EOP字节的控制器。当OPMODE[1:0]=11b时，
FUSB2805不能自动产生SYNC 和EOP。FUSB2805 NRZI对数
据进行编码，并执行位填充。链接器必须始终采用
如果数据被设置成00h，FUSB2805 不会发送EOP。
FUSB2805仍然检测PID字节是否为A5h (表示SOF)，并且当
STP被声明时发出一个长EOP。发出招呼和恢复发出信号之
前，链接器需要设置OPMODE[1:0]=10b。
图19中给出了SYNC和EOP不自动产生的USB数据包。
关于SYNC and EOP不自动产生功能的详情，请参阅ULPI规
范的第3.8.5.6节。
TXCMD(NOPID)数据包字节进行数据包发送。FUSB2805不提
供单独字节的位填充，但是当STP被声明、数据设置为FEh
时，FUSB2805为EOP而自动关闭位填充。当STP被声明时，
ULPI Signals
CLOCK
….
DN-1 DN FEh
00h
00h
00h
08h PID
D1
D3
….
TXCMD
D2
D [7:0]
DIR
STP
NXT
UTMI+ Equivalent Signals
TxValid
TxReady
TxBitstuffEnable
USB Signals
Idle
Sync
Data Payload
PID
EOP
Idle
D+/D-
图21.
SYNC和EOP不自动产生的USB数据包(OpMode=11b)
VA_VBUS_VLD阈值允许A-device 确定是否它有能力在VBUS
引脚上输出一个有效电压。对于FUSB2805而言，当一个A-
device时，VBUS 电源电压处于设备的外部，因此必须使
用ExtVBUSIndicator信号。
OTG工作
FUSB2805完全兼容OTG修订版1.3。双用设备的支持功能模
块包括：
. 电压比较器（VBUS-有效、会话结束、会话有效信
号）
这些比较器是受控的，用于确定何时 RXCMD 被发送，需
要操作 INTF_CTRL、OTG_CTRL、 USB_INTR_R、
USB_INTR_F、USB_INTR_{0}STAT 与 USB_INTR_L寄存器。
. DP 和DM上拉和下拉电阻，兼容USB2.0电阻ECN
. micro-A 或micro-B插座插入的ID检测
. VBUS 充电和放电电阻
表13定义了UseExternalVbusIndicator、
IndicatorPassThru和IndicatorComplement寄存器位以及
内部VBUS-valid比较器输出的用法。 前者用于控制
ExternalVbusIndicator输入引脚的使用。图22给出了
RXCMD VBUS valid 的图示（图解表示）。
VBUS 比较器
由于重叠阈值，FUSB2805将A-device 和B-device会话有
效信号组合到VSESS_VLD， 重叠阈值允许这样的组合。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
31
上拉和下拉电阻
FUSB2805集成有DP 和DM 终端电阻，用于启动数据线脉
冲。根据表4，连接上拉和下拉电阻。
与 ULPI 相关的 OTG 功能详细信息，请参考 ULPI 规范
第 3.8.7 节或 USB 2.0 规范 OTG 补码修订版 1.3。有
关 OTG VBUS比较器阀值的更多详细信息，请参考 ULPI 规
范第 3.8.7.3 节。
表13. RXCMD VBUS_VALID过流条件
使用外部 VBUS指
典型应用
指示信号穿通 指示信号补偿
RXCMD VBUS有效源
示信号
OTG 器件
0
1
1
无关
无关
内部 VA_VBUS_VLD比较器
1
1
0
1
外部高电平有效 VA_VBUS_VLD信号
外部低电平有效 VA_VBUS_VLD_N信号
外部高电平有效电源故障信号符合内部
VA_VBUS_VLD比较器要求
1
1
0
0
1
0
外部低电平有效电源故障信号符合内部
VA_VBUS_VLD比较器要求
1
1
0
1
1
0
1
外部高电平有效电源故障信号
外部低电平有效电源故障信号
内部 VA_VBUS_VLD比较器
标准主机
标准外设
无关
无关
VBUS
(0,X)
+
-
Internal VbusValid
(1,0)
(1,1)
RXCMD VbusValid
ExternalVbusIndicator (Fault)
ComplementOutput
IndicatorComplement
(UseExternalVbusIndicator, Indicator PassThru)
图22.
RXCMD Vbus 有效电源
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
32
串行模式
图23和图24提供了 6 引脚和 3 引脚串行模式的范例，通过
INTF_CTRL 寄存器中 6 引脚和 3 引脚寄存器位进行控制。
关于 3 引脚和 6 引脚串行模式的更多详情，请参阅 ULPI
规范的第 3.10 节。
TRANSMIT
RECEIVE
DATA[0]
Tx_Enable
EOP
EOP
SYNC
SYNC
DATA
DATA
DATA[1]
Tx_DAT/
RX_RCV
DATA[2]
Tx_SE0/
RX_SE0
DP
DM
图23.
3 引脚串行模式－收发范例
TRANSMIT
RECEIVE
DATA[0]
Tx_Enable
EOP
EOP
SYNC
SYNC
DATA
DATA
DATA[1]
Tx_DAT
DATA[2]
Tx_SE0
DATA[4]
Rx_DP
DATA[5]
Rx_DM
DATA[6]
Rx_RCV
DP
DM
图24.
6 引脚串行模式－收发范例
避免ULPI数据线争端
因为 ULPI 数据总线为双向的，因此可以避免链接器和
FUSB2805 同时驱动总线数据的情况 。
当 FUSB2805 想要控制数据总线启动数据传送时，FUSB2805 更
新 DIR 值由 0 为 1。
当在链接器上执行数据总线驱动控制时，应该考虑以下几个要
点：
此时，HOST/LINK应该禁用它的输出衬垫缓冲器。应该尽可能满
足这一点，因此 LINK 应该采用一个来自 DIR 的组合路径。
上电与时钟稳定后，缺省状态为：
FUSB2805 不能立即启用它的输出缓冲器，但是能够延时启用缓
冲器，直到下一个时钟边沿到来，避免总线争端。
.
.
.
FUSB2805 驱动 DIR=0。
当 FUSB2805 不再要求数据传送，改变 DIR 值由 1 到 0，立即
开始关闭它的输出驱动器。虽然 HOST/LINK 检测到 DIR 由 1
到 0 的变化，但是延时启用它的输出缓冲器，持续一个 CLOCK
周期，从而避免数据争端。
数据总线为 FUSB2805 的 INPUT。
HOST/LINK ULPI 数据总线为 OUTPUT(全部数据总线位驱动
为0)。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
33
ULPI寄存器
ULPI提供一个立即寄存器组，带有6位地址，为发送命令
字节的一部分。也提供有一个扩展寄存器组 （8位地
址），需要一个额外的时钟周期才能完成。立即寄存器组
被镜像到扩展寄存器低端。例如，扩展寄存器地址
00XXXXXX 在立即寄存器组上操作。FUSB2805 必须支持立
即和扩展寄存器操作。
FUSB2805 专用寄存器 － vendor ID、product ID 和率
控制寄存器，在以下各节进行描述。
表14. 寄存器映射
地址（6 位）
大小
字段名称
（位数）
Rd
Wr
设置
Clr
即时寄存器集
厂商 ID 低（参见表16）
厂商 ID 高（参见表16）
产品 ID 低（参见表16）
产品 ID 高（参见表16）
功能控制 （参见表17）
8
8
8
8
8
8
8
8
8
8
8
8
8
8
8
8
00h
01h
02h
03h
04-06h
07-09h
0A-0Ch
0D-0Fh
10-12h
13h
04h
07h
0Ah
0Dh
10h
05h
08h
0Bh
0Eh
11h
06h
09h
0Ch
0Fh
12h
接口控制（参见表18）
OTG 控制（参见表19）
USB 中断启用上升（参见表20）
USB 中断启用下降（参见表21）
USB 中断状态寄存器（参见表22）
USB 中断锁存寄存器（参见表23）
调试（参见表25）
14h
15h
暂存（参见表26）
16-18h
16h
17h
18h
保留(21)
19-2Eh
2Fh
30-3Ch
存取扩展寄存器集（参见下文）
保留（在 ULPI 规范中定义为视厂商而定）
扩展寄存器集
地址（8 位）
00-3Fh
映射至即时寄存器集（参见下面模式）
保留（80-FFh 在 ULPI 规范中定义为视厂商而定）
8
8
40-FFh
注：
21. 19-27h 汽车附件；FUSB2805 不支持。
表15. 寄存器存取图例
存取代码
扩展名称
含义
rd
wr
s
读
写
寄存器可以被读。如果这是给出的唯一模式，则只读。
数据总线上的码型可以被读，包括该寄存器所有位。
数据总线上的码型可以与寄存器相或，且被写入寄存器。
设置
数据总线上的码型为掩码。如果掩码中的一个位被置位，则相应的寄存器位被设置为
零（清零）。
c
清除
注意：
22. 上述寄存器组兼容在ULPI规范中定义的寄存器组。关于详情，请参阅ULPI规范1.1版中的第4.0节。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
34
FUSB2805专用的ULPI寄存器
表16. 供应方ID与产品ID寄存器
寄存器
位
存取
地址
数值
说明
VENDOR_ID_LOW
VENDOR_ID_HIGH
PRODUCT_ID_LOW
PRODUCT_ID_HIGH
7:0
7:0
7:0
7:0
rd
rd
rd
rd
00h
01h
02h
03h
79h
07h
00h
25h
供应方ID的较低字节，由USB-IF支持。固定值为79h。
供应方ID的较高字节，由USB-IF支持。固定值为07h。
产品ID号码的较低字节。固定值为00h。
产品ID号码的较高字节。固定值为25h。
功能扩展寄存器–FUNC_CTRL (04h-06h 读, 04h 写, 05h 置位, 06h 清位)
这些寄存器控制FUSB2805的UTMI功能设置。
表17. 功能扩展寄存器
字段名称
位
存取
复位
说明
选择收发器速度：
00b： 启用 HS 收发器
01b： 启用 FS 收发器
10b： 启用 LS 收发器
XcvrSelect
1:0
rd/wr/s/c
01b
11b： 为低速数据包启用FS收发器（缺省时FS序文暂停）
控制内部 1.5 kΩ 上拉电阻和 45 Ω HS 终端。通过 XcvrSelect、OpMode、
DpPulldown 和 DmPulldown 寄存器设置，控制总线电阻变化，如表4所示。对于具
有 HS 能力的收发器，由于 LS 外设从不支持 FS 或 HS，则 FUSB2805 不支持在
D-引脚上提供 1.5 k电阻。
TermSelect
2
rd/wr/s/c
rd/wr/s/c
0b
选择发送期间所需的位编码风格。
00b： 正常工作
01b： 非驱动
OpMode
4:3
00b
10b： 禁用位填充和 NRZI 编码
11b： 发送过程中不要自动添加 SYNC 和 EOP。
必须仅用于 HS 数据包。
有效高寄存器复位。链接器设置完该位后，FUSB2805 必须声明 DIR 和复位 UTMI+
核芯。当复位完成时，FUSB2805 解除声明 DIR 和自动清除该位。解除声明 DIR
后，FUSB2805 必须在此声明 DIR 且向链接器发出 RXCMD 更新。在使用 ULPI 总
线前，链接器必须等待 DIR 解除声明。不会复位 ULPI 接口或 ULPI 寄存器集。
0b： 未复位
复位
5
rd/wr/s/c
0b
1b： 复位
低电平有效 PHY 暂停。将 FUSB2805 设置为低耗模式。FUSB2805能够降低所有电
路模块的供电，但是FS接收器, OTG比较器和ULPI接口引脚例外。当退出低耗模式
SuspendM
6
7
rd/wr/s/c
rd/wr/s/c
1b
0b
时（链接器声明退出 STP 之前），FUSB2805 必须自动设置该位为 1b。0b： 低耗
模式
1b： 供电
保留
保留
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
35
接口控制寄存器–INTF_CTRL (07h-09h 读，07h 写, 08h 置位, 09h Clear清位)
这些寄存器控制FUSB2805的多种接口和PHY特征。在ULPI
规范1.1中，该寄存器中所有的位均被视为任选特性。但
是其中许多得到了FUSB2805的支持，并可用于继承链接核
芯。
表18. 接口控制寄存器
字段名称
位
存取
复位
说明
改变 ULPI 接口为 6 引脚串行模式。当串行模式退出时，
FUSB2805 必须自动清除该位。这是一种 ULPI PHY 支持的任选模
式。
6 引脚 FsLs 串行模式
0
rd/wr/s/c
0b
带有仅仅 4 个数据引脚的 PHY，D[3:0] 不支持这种模式。
0b： 利用并行接口发送 FS/LS 数据包。
1b： 采用 6 引脚串行接口发送 FS/LS 数据包。CLKIN 必须保持
运行。
6PIN_FSLS_SER
改变 ULPI 接口为 3 引脚串行模式。当串行模式退出时，
FUSB2805 必须自动清除该位。这是一种 ULPI PHY 支持的任选模
式。
3 引脚 FsLs 串行模式
1
rd/wr/s/c
0b
3PIN_FSLS_SER
0b： 利用并行接口发送 FS/LS 数据包。
1b： 采用 3 引脚串行接口发送 FS/LS 数据包。CLKIN 必须保持
运行。
汽车附件模式
（FUSB2805 不支持）
2
3
rd/wr/s/c
rd/wr/s/c
0b
0b
保留
低电平有效时钟暂停。用于以串行模式输出 CLOCK 信号。内部时
钟电路未限电，并且 CLKIN 必须保持串行模式运行。
0b： 时钟未以串行模式输出。
ClockSuspendM
1b： 时钟以串行模式输出。
启用 PHY，以自动发送恢复信令。
0b： 系统能够在 < 1 ms 时间内唤醒其 PHY 时钟信号并且禁用
自恢复特性。
自动恢复
4
5
6
rd/wr/s/c
rd/wr/s/c
rd/wr/s/c
0b
0b
0b
1b： 系统不能在 1 ms 内唤醒其 PHY 时钟信号并且启用自恢复
特性。
有关更多信息，请参考 USB2.0 规范第 7.1.7.7 和 7.12 小节。
通知 FUSB2805 倒转 ExternalVBUSIndicator 输入信号，生成补
偿输出（即故障信号）。
0b： FUSB2805 不会倒转 ExternalVBUSIndicator 信号（缺省信
号）。
指示信号补偿
IND_COMPL
1b： FUSB2805 倒转 ExternalVBUSIndicator 信号。
有关详细信息，请参考 ULPI 规范修订版 1.1，2004 年 10 月第
3.8.7.3 小节和图 45。
在 RXCMD VBUS状态中使用补偿输出前，控制补偿输出是否符合内
部 VBUSValid 比较器要求。
指示信号穿通
0b： 补码输出信号，符合内部 VBUSValid 比较器要求。
1b： 补码输出信号不符合内部 VBUSValid 比较器要求。
有关详细信息，请参考 ULPI 规范修订版 1.1，2004 年 10 月第
3.8.7.3 小节和图 45。
IND_PASS_THRU
接下页
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
36
字段名称
位
存取
复位
说明
控制电路内置于FUSB2805，在链接器进行三态STP和D[7:0]时，用来保护
ULPI接口。
该特性采用的任何上拉和下拉能够被禁用。该位不是用于影响保持状态的
工作。当该位启用时，FUSB2805 自动检测何时链接器停止驱动 STP。
0b： 启用接口保护电路（缺省时）。一只弱
接口保护禁用
INTF_PROT_DI
S
7
rd/wr/s/c
0b
上拉电阻附加到 STP 引脚，如果 STP 引脚意料之外为高电平，则
FUSB2805 在 D[7:0] 上附加弱下拉电阻，用来保护数据输入。
1b： 禁用接口保护电路。拆除 D[7:0] 上的弱下拉电阻和 STP 上的弱上
拉电阻。
有关详细信息，请参考 ULPI 规范修订版 1.1，2004 年 10 月第 3.12
小节。
OTG 控制寄存器–OTG_CTRL (0Ah-0Ch 读, 0Ah 写, 0Bh 置位, 0Ch 清位)
这些寄存器用于控制FUSB2805的UTMI+ OTG功能设置
表19. OTG控制寄存器
字段名称
位
存取
复位
说明
连接一个上拉电阻到 ID 线，允许采样信号电平。
0b： 禁止 ID 引脚采样
IDPullup
0
rd/wr/s/c
0b
1b： 允许采样信号电平
启用 D+(23)引脚上 15 kΩ 下拉电阻
0b： 下拉电阻未连接至 D+ 引脚
1b： 下拉电阻连接至 D+ 引脚
DpPulldown
DmPulldown
1
2
rd/wr/s/c
rd/wr/s/c
1b
1b
启用 D-(23)引脚上 15 kΩ 下拉电阻
0b： 下拉电阻未连接至 D- 引脚
1b： 下拉电阻连接至 D- 引脚
通过电阻对 VBUS放电。OTG 规范中定义最小阻值为 656 Ω。如果链接器设
置该位为 1b，链接器等待一个说明 SessEnd 已从 0b 过渡到 1b 的
RXCMD，然后将该位重置为 0b，以终止放电事件。
0b： 不会对 VBUS放电
DischrgVBUS
3
4
rd/wr/s/c
rd/wr/s/c
0b
0b
1b： 对 VBUS放电
通过电阻为 VBUS充电。用于 VBUS脉冲 SRP。可以使用一个最小值为 281 Ω
的输出阻抗以及 OTG 规范中定义的 3.0 V 电源。链接器必须首先确认
VBUS已被放电（参见 DischrgVBUS位）并且 D+ 和 D- 已持续发送信号 SE0
至少 2 ms。
ChrgVBUS
0b： 不会为 VBUS充电
1b： 为 VBUS充电
保留
5
6
rd/wr/s/c
rd/wr/s/c
0b
0b
保留
通过 PSW 引脚选择外部 5 V VBUS电源。
0b： 驱动 PSW 为低电平
DrvVBUS外部
1b： 驱动 PSW 为高电平
告知 FUSB2805 使用外部 VBUS过流指示信号。该位可选。
0b： 采用内部 OTG 比较器 (VA_VBUS_VLD) 或内部 VBUS有效指示信号（缺省信
号）。
使用外部 VBUS
7
rd/wr/s/c
0b
指示信号
1b： 在故障引脚上采用外部 VBUS有效指示信号有关详细信息，请参考
ULPI 规范修订版 1.1，2004 年 10 月第 3.8.7.3 小节。
注：
23. 电阻终端实现符合USB2.0 电阻ECN。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
37
USB中断许可(上升沿)寄存器–INTR_EN_R_CTRL (0Dh-0Fh 读, 0Dh 写, 0Eh 置位, 0Fh 清位)
当信号由低到高跳变事件，这些电阻位负责控制FUSB2805
的中断事件标志设置。缺省时，允许所有跳变。在任何模
式下，当上升沿和下降沿允许被禁用时，中断电路可以限
电。当CLOCK被限电时，为了确保可以检测到中断，链接
器应该同时允许上升沿和下降沿。
表20. USB中断允许（上升沿）寄存器
字段名称
HostDisconnect 上升
VBUSValid 上升
位
0
存取
复位
1b
说明
当HostDisconnect由低到高跳变时，产生一个中断事件标志。仅
在主机模式中适用(DpPulldown 和DmPulldown 同时设置为1b)。
rd/wr/s/c
rd/wr/s/c
rd/wr/s/c
rd/wr/s/c
1
1b
当VBUSValid由低到高跳变时，产生一个中断事件标志。
当SessValid由低到高跳变时，产生一个中断事件标志。
SessValid 等同于UTMI+ AValid。
SessValid 上升
SessEnd 上升
2
1b
3
1b
当SessEnd由低到高跳变时，产生一个中断事件标志。
当IDGnd由低到高跳变时，产生一个中断事件标志。IDGnd 在
IDPullup设置为1b后50ms内有效。否则，IDGnd不被定义并应该
被忽略。
IDGnd 上升
4
rd/wr/s/c
rd/wr/s/c
1b
0b
保留
7:5
保留
USB 中断许可(下降沿) 寄存器–INTR_EN_F_CTRL (10h-12h 读, 10h 写11h 置位, 12h 清位)
当信号由高到低跳变时，这些寄存器位负责控制FUSB2805
的中断事件标志设置。缺省时，允许所有跳变。在任何模
式下，当上升沿和下降沿允许被禁用时，中断电路可以限
电。当CLOCK被限电时，为了确保可以检测到中断，链接
器应该同时允许上升沿和下降沿。
注：
24. RxActive and RxError必须总是立即通信，这些事件
未包括在该寄存器中。
表21. USB中断许可(下降沿) 寄存器
字段名称
位
0
存取
复位
1b
说明
HostDisconnec
t 下降
当HostDisconnect由高低到跳变时，产生一个中断事件标志。仅在主
机模式中适用(DpPulldown 和DmPulldown 同时设置为1b)。
rd/wr/s/c
rd/wr/s/c
rd/wr/s/c
rd/wr/s/c
VBUSValid 下降
1
1b
当VBUSValid由高到低跳变时，产生一个中断事件标志。
SessValid 下
当SessValid由高到低跳变时，产生一个中断事件标志。 SessValid
等同于UTMI+ AValid。
2
1b
降
SessEnd 下降
IDGnd 下降
保留
3
1b
当SessEnd由高到低跳变时，产生一个中断事件标志。
当IDGnd由高到低跳变时，产生一个中断事件标志。IDGnd 在
IDPullup 设置为 1b 后 50ms 内有效。否则，IDGnd 不被定义并应
该被忽略。
4
rd/wr/s/c
rd/wr/s/c
1b
0b
7:5
保留
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
38
USB 中断状态寄存器–USB_INTR_STAT (13h 只读)
这些寄存器位代表中断事件源信号的当前值。在任何模式
下，当上升沿和下降沿允许被禁用时，中断电路可以限
电。当CLOCK被限电时，为了确保可以检测到中断，链接
器应该同时允许上升沿和下降沿。
表22. USB中断状态寄存器
字段名称
位
存取
复位
说明
UTMI+ VBUSValid输出的当前值。仅在主机模式中适用(DpPulldown
和DmPulldown 同时设置为1b)。 当进入低耗模式时，自动复位为
0b。
HostDisconnect
0
rd
0b
VBUSValid
SessValid
SessEnd
1
2
3
rd
rd
rd
0b
0b
0b
UTMI+ VBUSValid 输出的当前值
UTMI+ SessEnd 输出的当前值。SessValid 等同于UTMI+ AValid。
UTMI+ SessEnd 输出的当前值
UTMI+ SessEnd 输出的当前值。IDGnd 在 IDPullup 设置为 1b 后
50ms 内有效。否则，IDGnd 不被定义并应该被忽略。
IDGnd
4
rd
rd
0b
Xb
保留
7:5
保留
USB中断锁存–USB_INTR_L (14h 只读，同时自动清位)
当在相应的内部信号上出现一次未屏蔽跳变，FUSB2805将
给这些寄存器置位。当链接器读该寄存器时或当进入低耗
模式时，FUSB2805自动清除所有位。当进入6引脚或3引脚
串行模式时，不论ClockSuspendM的值如何，FUSB2805也
会清除该寄存器。在任何模式下，当上升沿和下降沿允许
被禁用时，中断电路可以限电。当CLOCK被限电时，为了
确保可以检测到中断，链接器应该同时允许上升沿和下降
沿。
链接器可以任选是否以同步模式读USB中断锁存寄存器，
原因是RXCMD字节已经直接反应了中断源。
表23. USN中断锁存寄存器
字段名称
位 存取 复位
说明
当未屏蔽事件出现在HostDisconnect上时，由FUSB2805设置为1b。读该寄存
器时，该位被清位。
HostDisconnec
t 锁存
0
rd
0b
仅在主机模式中适用(DpPulldown 和DmPulldown 同时设置为1b)。
当未屏蔽事件出现在VBUSValid上时，由FUSB2805设置为1b。读该寄存器时，
该位被清位。
VBUSValid 锁存
1
2
3
rd
rd
rd
0b
0b
0b
SessValid 锁
存
当未屏蔽事件出现在SessValid上时，由FUSB2805设置为1b。读该寄存器时，
该位被清位。SessValid 等同于UTMI+ AValid。
当未屏蔽事件出现在SessEnd上时，由FUSB2805设置为1b。读该寄存器时，该
位被清位。
SessEnd 锁存
当未屏蔽事件出现在IDGnd上时，由FUSB2805设置为1b。读该寄存器时，该位
被清位。IDGnd 在IDPullup设置为1b后50ms内有效。否则，IDGnd不被定义并
应该被忽略。
IDGnd 锁存
4
rd
rd
0b
0b
保留
7:5
保留
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
39
设置任何锁存寄存器位时，FUSB2805 必须遵循表24中定
义的规则。如果在相同的周期中寄存器读数据被返回到链
接器，则一个USB中断锁存位被置位，在寄存器读数据中
立即给出中断条件，锁存器不设置为1b。
表24. 中断锁存寄存器设置规则
输入条件
当前时钟周期内返回的寄存器读数据 当前时钟周期内设置的中断锁存位 (1b)
锁存寄存器位的所得值
否
否
是
是
否
是
否
是
0b
1b
0b
0b
调试寄存器(15h 只读)
这些寄存器位能够表示用于调试的多种信号的当前值。
表25. 调试寄存器
字段名称
LineState0
LineState1
保留
位
0
存取
rd
复位
0b
说明
包含 Linestate0 的当前值
包含 Linestate1 的当前值
保留
1
rd
0b
7:2
rd
0b
Scratch 寄存器(16h-18h 读, 16h 写, 17h 置位, 18h 清位)
这些寄存器位能够表示用于调试的多种信号的当前值。
表26. 暂存寄存器
字段名称 位
存取
复位
说明
用于测试的空寄存器字节。软件可以读、写、设置和清除该寄存器并且不
会影响 FUSB2805 功能。
暂存
7:0
rd/wr/s/c
00h
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
40
绝对最大额定值
应力超过绝对最大额定值，可能会损坏器件。在超出推荐的工作条件的情况下，该器件可能无法正常工作，所以不建议
让器件在这些条件下长期工作。此外，过度暴露在高于推荐的工作条件下，会影响器件的可靠性。绝对最大额定值仅是
应力规格值。
符号
参数
最小值
最大值
单位
连续
脉冲
-0.5
-0.5
-0.5
+5.5
+5.5
+5.5
VCC
VIO
电源电压(25)
V
V
I/O 电源电压
引脚： STP, DIR, NXT, D[7:0], CFG1,
-0.5
VIO + 0.5
RESET_N, CLKIN
VIN
DC 输入电压(26)
V
引脚： FAULT、Chip_Select_N
引脚： DP, DM, VBUS
-0.5
-0.5
-50
+5.5
5.5(27)
IIK
ILU
直流输入二极管电流
直流闭锁电流
存储温度
mA
mA
-100
-65
TSTG
+150
6
°C
全部引脚
人体模型，JEDEC:
输入/输出至地
电源至地
12
12
JESD22-A114
kV
V
ESD
充电器件模型，JEDEC: JESD22-C101
IEC 61000 板级，空气间隙
2
19
机型，JEDEC： JESD22-A115
350
注意：
25. VCC能够承受的短时（最大 5 ms）脉冲电压不超过 5.5 V 峰值电压。
26. 只有当输入与输出二极管电流额定值能够得到保证时，可以超出输入与输出的负额定值。
27. 采用一只外部串联电阻时，VBUS 能够承受较高电压。目标为串联电阻 1 kΩ ±5%时承受 > 10 V 电压且超过 5s。
推荐工作条件
推荐的操作条件表定义了器件的真实工作条件。指定推荐的工作条件，以确保器件的最佳性能达到数据表中的规格。飞
兆半导体建议不要超过推荐工作条件，也不能按照绝对最大额定值进行设计。
符号
参数
最小值
典型值
最大值
单位
VCC
VCC3V3
VDD1V2
VIO
电源电压
2.7
VCC-0.1
1.08
3.6
3.30
1.20
4.5
V
3.60
1.32
3.60
内部调节电源电压
V
V
I/O 电源电压
1.65
输入电压 – 数字 I/O(28)（STP、D[7:0]、CFG1、NXT、DIR、
FAULT、CLKIN、RESET_N）
0
VIO
VIN
V
VBUS, Chip_Select_N
0
5.25
3.6
VAIO
TA
输入电压 – 模拟 I/O（DP、DM、ID）
工作温度
-0.5
-40
V
+25
+85
°C
注：
28. 这些数字输入必须保持高或低。不许悬浮。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
41
静态特性
除非另有说明，VCC3V3= VCC-0.1 至 3.6 V；VDD1V2= 1.1 V 至 1.25 V；VIO= 1.65 V 至 3.60 V；TJ=-40°C 至 +85°C。
符号
参数
上电复位跳闸电压
工作电源电流
工作条件
最小值 典型 最大值 单位
值
电源引脚
VPOR
参考 VDDIO电源
1.4
V
12 MHz、50 pF 负载条件下的全速
25
数据
12 MHz、空闲条件下的全速数据
480 MHz 频率下的 HS 接收
480 MHz 频率下的 HS 发送
23
31
36
IVCC
mA
Bit SuspendM = 0b、
CLKIN
IVCC(lowpwr)
低耗模式电源电流(32)
95
200
36
µA
µA
= LOW、PSW 被解除声明
VIO关闭或 Chip_Select_N
被解除声明、不存在 VBUS
IPWRDN
节电模式下来自 VCC的电流
VIO工作电源电流
22
IIO
时钟和 ULPI 空闲时为 12pF
2.1
mA
IIOPWRDN
节电模式下 VIO静态电源电流 Chip_Select_N De-asserted
2
2
µA
暂停模式（低耗）下 VIO静态
I/O 引脚空闲
IIOSPND
µA
µA
电源电流
暂停模式（低耗）下 VBUS静态
I/O 引脚空闲
IVBUS_SUSPND
60
90
电源电流
数字引脚（CLOCK、DIR、STP、NXT、D0-D7、RESET_N）
VIL
VIH
VOL
VOH
输入电压低电平
输入电压高电平
输出电压低电平
输出电压高电平
0.3•VIO
V
0.7•VIO
V
V
V
IOL=4 mA
IOH=4 mA
0.4
VIO-0.4
25
输入下拉电流
IPD
IPU
VIN=VIO
50
90
µA
µA
（接口保护 – D[7:0]）
输入上拉电流
（接口保护 –STP）
VIN=0 V
-30
-50
-80
数字引脚 (FAULT)
VIL
VIH
IIN
输入电压低电平
0.8
1
V
V
输入电压高电平
输入漏电流
2.0
-1
µA
数字引脚 (PSW)
VOHPSW
IOHPSW
输出电压高电平- PSW
高电平电流 - PSW
外部 100 k电阻下拉至 GND
外部 100 k电阻下拉至 GND
2.6
3.6
4
V
mA
接下页
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
42
静态特性（接上页）
除非另有说明，VCC3V3= VCC-0.1 至 3.6 V；VDD1V2= 1.1 V 至 1.25 V；VIO= 1.65 V 至 3.60 V；TJ=-40°C 至 +85°C。
符号
参数
工作条件
最小值 典型值 最大值 单位
模拟 I/O 引脚（DP、DM）
FS/LS 路径
VDI
VCM
VIL
VIH
差分输入灵敏度
差分共模电压
|VDP – VDM|
0.2
2.5
0.8
V
V
V
V
包括 VDI范围
0.8
输入电压低电平
输入电压高电平
2.0
0
DP 引脚上拉电阻
VOL
输出电压低电平
输出电压高电平
0.3
V
RL= 1.5 k 至 3.6 V
DP/DM 引脚下拉电阻
VOH
VTERM
RPU
2.8
3.0
900
3.6
3.6
V
V
RL= 15 k 连接至 GND
1.5 kΩ 上拉电阻的终端电压
DP 引脚上的上拉电阻
符合 USB 2.0 电阻 ECN
要求
1575
Bit DP_WKPU_EN = 1、
VBUS> VA-SESS_VLD
RWKPU
DP 引脚上的弱上拉电阻
105.8
132.0
158.0
k
HS 路径
已检测静噪
未检测静噪
100
625
VHSSQ
高速静噪检测阀值
mV
150
525
300
-50
-10
-10
360
700
-900
-4
VDSCHS
VDIHS
VCMHS
VILHS
VIHHS
VOLHS
VCHIRPJ
VCHIRPK
IOZ
HS 断连检测阀值（差分）
HS 差分输入灵敏度
mV
mV
mV
mV
mV
mV
mV
mV
µA
|VDP – VDM|
HS 差分共模电压
包括 VDIHS范围
+500
+10
+10
440
1100
-500
+4
HS 空闲电平输入电压（差分）
HS低电平输入电压（差分）
HS高电平输出电压
Chirp-J 输出电压（差分）
Chirp-K 输出电压（差分）
漏电流
符合 USB 2.0 规范中的
ZDRV
ZIN
RPD
驱动器输出阻抗（HS 和 FS）
输入阻抗
40.5
0.8
49.5
稳态条件
M
k
pF
符合 USB 2.0 电阻 ECN
DP 和 DM 引脚下拉电阻
电容值
14.25
24.80
10
要求
CI/O
VBUS 比较器
Vth(VBUSVLD)
该引脚连接至 GND
VBUS 有效阀值
4.40
0.2
4.75
0.8
V
Vth(SESSEND)
VBUS会话结束比较器阀值
VBUS会话结束比较器滞洄
VBUS会话有效比较器阀值
VBUS会话有效比较器滞洄
V
mV
Vhys(SESSEND)
Vth(SESSVLD)
150
200
A-Device 和 B-Device
0.8
2.0
V
Vhys(SESSVLD)
mV
接下页
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
43
静态特性（接上页）
除非另有说明，VCC3V3= VCC-0.1 至 3.6 V；VDD1V2= 1.1 V 至 1.25 V；VIO= 1.65 V 至 3.60 V；TJ=-40°C 至 +85°C。
符号
参数
工作条件
最小值 典型值 最大值 单位
VBUS电阻
RVBUS(PU)
RVBUS(PD)
CHRG_VBUS= 1 时，连接至
VCC3V3
VBUS充电电阻
VBUS放电电阻
281
DISCHRG_VBUS= 1 时连接至
656
80
GND
不在节电模式
90
100
100
RVBUS(IDLE)
VBUS空闲阻抗
k
Chip Select 被解除声明
或 VIO丢失
40
ID 检测电路 (ID)
tID
RID_PU
ID检测时间
50
40
ms
k
k
V
ID 上拉电阻
ID 弱上拉电阻
ID 上拉参考
ID 阀值
Bit ID_PULL_UP=1
50
60
RID_PU_WK
Bit ID_PULL_UP = 0
320
3.0
1.0
400
3.3
480
3.6
2.0
VPU_ID
VTH_ID
V
外部电阻参考
外部 RREF (12 kΩ ±1%) 两侧的电
压
VRREF
SUSPENDM Bit=HIGH
0.8
V
复位
CLKIN 运行，
Autoresume = 0
CLKIN 必须首先启动(30)，
Autoresume = 1
850
µs
µs
当出现远程唤醒事件时，PHY 时钟
启动
tSTART_HOST
110.9
时钟输入
USB 配置 0
USB 配置 1
19.2
26.0
fCLKIN
输入时钟频率(31)
MHz
JCLKIN
CLKIN
VCLKIN
RMS 抖动
占空比
振幅
200
5
ps
%
50
1.8
V
tR_CLKIN, tF_CLKIN 上升和下降事件
ns
输出时钟特性
只有当 CLKIN 上一个时
fCLK60_OUT
输出时钟频率
60
50
MHz
钟为输入时才有效
JCLK60_OUT
RMS 输出抖动
500
4.0
ps
%
CLK60_OUT
占空比
CLOCK 引脚从 VIO的 10%
过渡到 90%
tR_CLK60
上升时间
1.0
1.0
ns
(CL -412 pF)
CLOCK 引脚从 VIO的 90%
过渡到 10% (CL –
412 pF)
tF_CLK60
下降时间
4.4
640
ns
在 STP 引脚电源正常或
声明时测得
tstartPLL
启动（PLL 稳定）时间
µs
注意：
29. 当配置成外设控制器时，不包括流过 15 k主机下拉电阻的暂态电流。通常，额外允许 200 µA 电流。
30. 唤醒 CLKIN 所需时间，为外部系统定时的函数，因此远程唤醒性能需要能够自恢复（参见图20）。
31. 外部时钟可以施加在CLKIN引脚。建议频率精度为 200 ppm。
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
44
动态特性
除非另有说明，VCC3V3= VCC-0.1 至 3.6 V；VDD1V2= 1.1 V 至 1.25 V；VIO= 1.65 V 至 3.60 V；TJ= -40°C 至 +85°C
符号
参数
工作条件
最小值 典型值 最大值 单位
输出时钟特性
fCLK60_OUT
输出时钟频率
只有当 CLKIN 上一个时钟为输入时才有效
60
50
MHz
ps
%
JCLK60_OUT
RMS 输出抖动
500
4.0
CLK60_OUT
占空比
CLOCK 引脚从 VIO的 10% 过渡到 90% (CL
– 4-12 pF)
tR_CLK60
上升时间
1.0
1.0
ns
CLOCK 引脚从 VIO的 90% 过渡到 10% (CL
– 4-12 pF)
tF_CLK60
下降时间
4.4
640
ns
tstartPLL
稳压器特性
tregPWRUP
启动（PLL 稳定）时间
在 STP 引脚电源正常或声明时测得
µs
稳压器上电时间
稳压器下电时间
VCC3V3和 VDD1V2上 4.7 µF ±20% 的解耦
VCC3V3和 VDD1V2上 4.7 µF ±20% 的解耦
1.2
100
ms
ms
tregPWRDN
数字 I/O 引脚
CIN
引脚输入电容值
引脚输入电容值
引脚输出电容值
仅输入引脚（STP、RESET_N）
2.7
2.7
2.7
3.0
3.0
3.0
3.5
3.5
3.5
pF
pF
pF
CIN_BIDI
用作输入的双向引脚 （CLK、D0-D7）
输出（数字）引脚（NXT、DIR、CLKOUT）
COUT
ULPI 接口单数据速率 (SDR) 时间
仅输入引脚 (STP) 和作
输出 60 MHz 时
tSU
与时钟上升沿有关的设置时间 为输入的双向引脚 (D0-
6
0
ns
ns
钟
D7)
仅输入引脚 (STP) 和作
输出 60 MHz 时
tHD
与时钟上升沿有关的保持时间 为输入的双向引脚 (D0-
钟
D7)
所有 ULPI 引脚
上的输出
tDC
与时钟上升沿有关的输出延迟 仅输出引脚（DIR、NXT）
9
9
ns
ns
60 MHz 时钟，
12 pF
所有 ULPI 引脚
上的输出
作为输出的双向引脚
与时钟上升沿有关的输出延迟
(D0-D7)
tDD
60 MHz 时钟，
12 pF
trise
tfall
上升时间
下降时间
从 VIO的 10% 过渡到 90% (CL – 4-12 pF)
从 VIO的 90% 过渡到 10% (CL – 4-12 pF)
1.0
1.0
5.0
5.0
ns
ns
ULPI 接口退出和进入低耗模式
从 DIR LH 过渡到 CLOCK 停止（最少 6
tCS
进入低耗模式时间
0.145
µs
个周期）
tSTP
tWU
低耗模式延迟(32)
从 DIR LH 过渡 STP 到 LH 过渡
从 STOP LH 过渡到 DIR HL 过渡
从停止 LH 过渡到 Clock 开始
2
µs
µs
µs
退出低耗模式 （总唤醒时间）
退出低耗模式 （时钟唤醒时间）
111
tCWU
110.9
从时钟开始到 DIR HL 过渡
（6 个时钟周期）
tCD
退出低耗模式 （时钟至 DIR）
97
ns
接下页
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
45
动态特性（接上页）
除非另有说明，VCC3V3= VCC-0.1 至 3.6 V；VDD1V2= 1.1 V 至 1.25 V；VIO= 1.65 V 至 3.60 V；TJ= -40°C 至 +85°C
符号
参数
工作条件
最小值 典型值 最大值 单位
模拟 I/O 引脚
高速驱动器特性
tHSR
tHSF
差分上升时间
差分下降时间
500
500
ps
ps
全速驱动器特性
tFR
tFF
上升时间
下降时间
CL= 50 pF；|VOH –VOL| 的 10% to 90%
CL= 50 pF；|VOH –VOL| 的 10% to 90%
不包括空闲状态下的首次过渡
4
4
20
20
ns
ns
%
FRFM
VCRS
差分上升时间/ 下降时间匹配
90.0
1.3
111.1
2.0
输出信号交叉电压
不包括空闲状态下的首次过渡
V
CL= 200 pF 至 600 pF；启用
D- 引脚上的 1.5 kΩ 上拉电阻；
|VOH –VOL| 的 10% to 90%
tLR
上升时间
75
300
ns
CL= 200 pF 至 600 pF；启用
D- 引脚上的 1.5 kΩ 上拉电阻；
|VOH –VOL| 的 10% to 90%
tLF
下降时间
75
300
125
ns
%
LRFM
差分上升时间/ 下降时间匹配
不包括空闲状态下的首次过渡
80.0
串行模式驱动器时间
驱动器串行模式传播延迟（低电平至
tPLHDS
TX_DAT [D1]、TX_SE0 [D2] 至 D+/D-
TX_DAT [D1]、TX_SE0 [D2] 至 D+/D-
20
20
ns
ns
高电平）
驱动器串行模式传播延迟（高电平至
低电平）
tPHLDS
tPHZLZDS
tPZHZLDS
驱动器串行模式禁用延迟
驱动器串行模式启用延迟
TX_ENABLE [D0] 至 D+/D-
TX_ENABLE [D0] 至 D+/D-
12
20
ns
ns
串行模式接收器时间
接收器串行模式传播延迟（低电平至
tPLHRS
tPHLRS
tPLHPS
tPHLPS
tPLHMS
tPHLMS
D+/D- 至 RX_RCV [D6]
D+/D- 至 RX_RCV [D6]
D+ 至 RX_DP[D4]
20
20
20
20
20
20
ns
ns
ns
ns
ns
ns
高电平）
接收器串行模式传播延迟（高电平至
低电平）
单端 VP串行模式传播延迟（低电平
至高电平）
单端 VP串行模式传播延迟（高电平
D+ 至 RX_DP[D4]
至低电平）
单端 VM串行模式传播延迟（低电平
D- 至 RX_DM [D5]
D- 至 RX_DM [D5]
至高电平）
单端 VM串行模式传播延迟（高电平
至低电平）
注：
32. 参数由设计者提供
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
46
物理尺寸
5.25 MIN
(3.75)
3.10 MAX
0.15
C
5.10
4.90
(0.60 )
(0.48 )
B
(2X)
A
5.25 MIN
(3.75 )
5.10
4.90
3.10 MAX
PIN #1 IDENT
(0.21 )
X4
0.15 C
(2X)
TOP VIEW
0.28 MAX
X32
0.50
RECOMMENDED LAND PATTERN
0.80 MAX
0.10 C
(0.20)
C
32X
0.08 C
0.05
0.00
SEATING PLANE
SIDE VIEW
NOTES:
3.20
3.00
A. EXCEPT WHERE NOTED, CONFORMS TO JEDEC REGISTRATION
MO-220, VARIATION WHHD-6.
A
B. DIMENSIONS ARE IN MILLIMETERS.
C. DIMENSIONS AND TOLERANCES PER ASME Y14.5M-1994.
D. LAND PATTERN PER IPC SM-782.
0.50
0.30
1
8
PIN #1 IDENT
E. DIMENSIONS ARE NOT INCLUSIVE OF BURRS, MOLD FLASH, OR
TIE BAR PROTRUSIONS.
F. DRAWING FILENAME: MKT-MLP32Brev1.
9
32
0.50
9
0.4
3.20
3.00
(DATUM B)
(DATUM A)
25
16
17
24
32X
0.18-0.30
0.10
0.05
C
C
A B
0.50
BOTTOM VIEW
图25.
32引脚模塑无铅封装(MLP)
封装图纸是作为一项服务而提供给考虑选用飞兆半导体产品的客户。具体参数可能会有变化，且不会做出相应通知。请注意图纸上的
版本和/或日期，并联系飞兆半导体代表核实或获得最新版本。封装规格并不扩大飞兆公司全球范围内的条款与条件，尤其是其中涉及
飞兆公司产品的保修。
随时访问飞兆半导体在线封装网页，可以获取最新的封装图纸：
http://www.fairchildsemi.com/dwg/ML/MLP32B.pdf.
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
47
© 2008 Fairchild Semiconductor Corporation
www.fairchildsemi.com
FUSB2805 • Rev. 1.0.3
48
ON Semiconductor and
are trademarks of Semiconductor Components Industries, LLC dba ON Semiconductor or its subsidiaries in the United States and/or other countries.
ON Semiconductor owns the rights to a number of patents, trademarks, copyrights, trade secrets, and other intellectual property. A listing of ON Semiconductor’s product/patent
coverage may be accessed at www.onsemi.com/site/pdf/Patent−Marking.pdf. ON Semiconductor reserves the right to make changes without further notice to any products herein.
ON Semiconductor makes no warranty, representation or guarantee regarding the suitability of its products for any particular purpose, nor does ON Semiconductor assume any liability
arising out of the application or use of any product or circuit, and specifically disclaims any and all liability, including without limitation special, consequential or incidental damages.
Buyer is responsible for its products and applications using ON Semiconductor products, including compliance with all laws, regulations and safety requirements or standards,
regardless of any support or applications information provided by ON Semiconductor. “Typical” parameters which may be provided in ON Semiconductor data sheets and/or
specifications can and do vary in different applications and actual performance may vary over time. All operating parameters, including “Typicals” must be validated for each customer
application by customer’s technical experts. ON Semiconductor does not convey any license under its patent rights nor the rights of others. ON Semiconductor products are not
designed, intended, or authorized for use as a critical component in life support systems or any FDA Class 3 medical devices or medical devices with a same or similar classification
in a foreign jurisdiction or any devices intended for implantation in the human body. Should Buyer purchase or use ON Semiconductor products for any such unintended or unauthorized
application, Buyer shall indemnify and hold ON Semiconductor and its officers, employees, subsidiaries, affiliates, and distributors harmless against all claims, costs, damages, and
expenses, and reasonable attorney fees arising out of, directly or indirectly, any claim of personal injury or death associated with such unintended or unauthorized use, even if such
claim alleges that ON Semiconductor was negligent regarding the design or manufacture of the part. ON Semiconductor is an Equal Opportunity/Affirmative Action Employer. This
literature is subject to all applicable copyright laws and is not for resale in any manner.
PUBLICATION ORDERING INFORMATION
LITERATURE FULFILLMENT:
N. American Technical Support: 800−282−9855 Toll Free
USA/Canada
Europe, Middle East and Africa Technical Support:
Phone: 421 33 790 2910
Japan Customer Focus Center
Phone: 81−3−5817−1050
ON Semiconductor Website: www.onsemi.com
Order Literature: http://www.onsemi.com/orderlit
Literature Distribution Center for ON Semiconductor
19521 E. 32nd Pkwy, Aurora, Colorado 80011 USA
Phone: 303−675−2175 or 800−344−3860 Toll Free USA/Canada
Fax: 303−675−2176 or 800−344−3867 Toll Free USA/Canada
Email: orderlit@onsemi.com
For additional information, please contact your local
Sales Representative
© Semiconductor Components Industries, LLC
www.onsemi.com
相关型号：
©2020 ICPDF网 联系我们和版权申明